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参数资料
| 型号： | DP83848HSQ/NOPB |
| 厂商： | National Semiconductor |
| 文件页数： | 62/82页 |
| 文件大小： | 0K |
| 描述： | IC TXRX ETHERNET PHYTER 40-LLP |
| 产品培训模块： | PHYTER® Family |
| 标准包装： | 1 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 1/1 |
| 规程： | 以太网 |
| 电源电压： | 3 V ~ 3.6 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-WFQFN 裸露焊盘 |
| 供应商设备封装： | 40-LLP-EP（6x6） |
| 包装： | 剪切带 (CT) |
| 配用： | DP83848H-MAU-EK-ND - BOARD EVALUATION DP83848H |
| 其它名称： | *DP83848HSQ/NOPB DP83848HSQCT |
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www.national.com
64
DP
83
848
H
8.2.5 100 Mb/s MII Receive Timing
Note: RX_CLK may be held low or high for a longer period of time during transition between reference and recovered
clocks. Minimum high and low times will not be violated.
8.2.6 100BASE-TX Transmit Packet Latency Timing
Note: For Normal mode, latency is determined by measuring the time from the first rising edge of TX_CLK occurring after
the assertion of TX_EN to the first bit of the “J” code group as output from the PMD Output Pair. 1 bit time = 10 ns in 100
Mb/s mode.
Parameter
Description
Notes
Min
Typ
Max
Units
T2.5.1
RX_CLK High/Low Time
100 Mb/s Normal mode
16
20
24
ns
T2.5.2
RX_CLK to RXD[3:0], RX_DV, RX_ER Delay 100 Mb/s Normal mode
10
30
ns
Parameter
Description
Notes
Min
Typ
Max
Units
T2.6.1
TX_CLK to PMD Output Pair
Latency
100 Mb/s Normal mode
6
bits
RX_CLK
RXD[3:0]
RX_DV
Valid Data
RX_ER
TX_CLK
TX_EN
TXD
PMD Output Pair
(J/K)
IDLE
DATA
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PDF描述 |
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参数描述 |
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