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参数资料
| 型号： | DS21Q50LN |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 81/87页 |
| 文件大小： | 0K |
| 描述： | IC TRANSCEIVER E1 QD IND 100LQFP |
| 产品培训模块： | Lead (SnPb) Finish for COTS |
| 产品变化通告： | Product Discontinuation 20/Feb/2012 |
| 标准包装： | 90 |
| 功能： | 收发器 |
| 接口： | E1 |
| 电路数： | 4 |
| 电源电压： | 3.14 V ~ 3.47 V |
| 电流 - 电源： | 230mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-LQFP（14x14） |
| 包装： | 托盘 |
| 包括： | AIS 警报检测器和发生器，回送功能，PRBS 发生器 / 检测器，远程检测器和发生器 |
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DS21Q50
82 of 87
21.4 Receive AC Characteristics
AC CHARACTERISTICS—RECEIVER
(VDD = 3.3.0V
±5%, TA = 0°C to +70°C for DS21Q50L; VDD = 3.3.0V ± 5%, TA = -40°C to +85°C for DS21Q50LN.)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
SYSCLK Period (Note 1)
tSP
122
488
ns
tSH
50
SYSCLK Pulse Width
tSL
50
ns
RSYNC Setup to SYSCLK
Falling
tSU
20
tSH - 5
ns
RSYNC Pulse Width
tPW
50
ns
Delay RCLK to RSER Valid
tD1
50
ns
Delay RCLK to RSYNC,
OUTA, OUTB
tD2
50
ns
Delay SYSCLK to RSER Valid
tD3
50
ns
Delay SYSCLK to RSYNC,
OUTA, OUTB
tD4
50
ns
Note 1: SYSCLK = 2.048MHz.
Figure 21-9. Receive AC Timing (Receive Elastic Store Disabled)
tD1
3
tD2
RSER
RSYNC
OUTA / OUTB (*RCLK)
MSB of
Channel 1
2
OUTA / OUTB
4
OUTA / OUTB
5
OUTA / OUTB (RCLK)
1
NOTE 1: OUTA OR OUTB CONFIGURED TO OUTPUT RCLK (NONINVERTED).
NOTE 2: OUTA OR OUTB CONFIGURED TO OUTPUT RCLK (INVERTED).
NOTE 3: RSYNC IS IN THE OUTPUT MODE (RCR1.5 = 0).
NOTE 4: OUTA OR OUTB CONFIGURED TO OUTPUT RFSYNC, CRC4 MF SYNC, OR CAS MF SYNC (NONINVERTED).
NOTE 5: OUTA OR OUTB CONFIGURED TO OUTPUT RFSYNC, CRC4 MF SYNC, OR CAS MF SYNC (INVERTED).
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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