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参数资料
| 型号： | DS26334GNA3+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 26/121页 |
| 文件大小： | 0K |
| 描述： | IC LIU E1/T1/J1 3.3V 256-CSBGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 90 |
| 类型： | 线路接口装置（LIU） |
| 驱动器/接收器数： | 16/16 |
| 规程： | IEEE 1149.1 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA，CSBGA |
| 供应商设备封装： | 256-CSBGA（17x17） |
| 包装： | 托盘 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页
DS26334 3.3V, 16-Channel, E1/T1/J1 Short/Long-Haul Line Interface Unit
Maxim cannot assume responsibility for use of any circuitry other than circuitry entirely embodied in a Maxim product. No circuit patent licenses are implied. Maxim
reserves the right to change the circuitry and specifications without notice at any time.
M a xi m I n t e g r a t ed P r o d u ct s , 1 20 S an G ab r i el D r i ve , S u n n yval e , C A 940 86 408 - 7 37 - 7600
2011 Maxim Integrated Products
Maxim is a registered trademark of Maxim Integrated Products, Inc.
121 of 121
REVISION
DATE
DESCRIPTION
PAGES
CHANGED
In the GC register (LIUs 9–16), changed bit 7 from Reserved to RIMPMS and
changed bit 2 from Reserved to CALEN (see also page 44, Table 6-5).
57
For TST, changed bits 7, 6, and 5 from Reserved to JABWS1, JABWS0, and
RHPMC.
58
In the bit 7 (RIMPON) description, changed GC.RTCTL to TST.RHPMC; added note
to bit description.
60
Changed bit description for OE bits 7 to 0.
61
For EZDE, corrected bit names for LIUs 1–16 from EXZDE[1:16] to EZDE[1:16];
changed bit description to say “Excessive zero detection is only relevant when
HDB3 or B8ZS decoding is enabled.” For CVDEB, changed bit description to say
“Code violation detection is only relevant when HDB3 decoding is enabled (LCS
register).”
65
In Table 12-1, deleted “Power Dissipation in Package”; added new Table 12-2.
Package Power Dissipation (for Thermal Considerations) and Table 12-3. Per-
Channel Power-Down Saving (for Thermal Considerations).
118
Added note to bit 3 (RSMM1:RSSM4) description and updated descriptions for bits
6–4 and 2–0 (deleted “When” from each sentence for clarity).
71, 72, 73,
74
Updated package drawing information.
117
053107
Table 8-3: added “Note 1: Specifications to -40
°C are guaranteed by design (GBD)
and not production tested.”
98
Table 9-3, 9-4, 9-5, 9-6: added “Note 1: The timing parameters in this table are
guaranteed by design (GBD).”
100, 103,
106, 109
012108
Changed the GC (2Fh) register bit 1 (JAPS) description.
57
3/11
Figure 10-1 in Section 10 PIN CONFIGURATION: Corrected cell R9. Changed from
DVSS to RESREF
116
Pb-free ordering information added
1
Table 4-1. PIN DESCRIPTION. TRSTB Function description changed. Replaced
“floating” with “unconnected”
15
Soldering information in ABSOLUTE MAXIMUM RATINGS table updated
98
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