参数资料
| 型号： | DS3172N+ |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 188/234页 |
| 文件大小： | 0K |
| 描述： | IC TXRX DS3/E3 DUAL 400-BGA |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 4 |
| 功能： | 单芯片收发器 |
| 接口： | DS3，E3 |
| 电路数： | 2 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 电流 - 电源： | 328mA |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-BBGA |
| 供应商设备封装： | 400-PBGA（27x27） |
| 包装： | 管件 |
| 包括： | DS3 调帧器，E3 调帧器，HDLC 控制器，芯片内 BERT |
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DS3171/DS3172/DS3173/DS3174
57
10.2.3 Line IO Pin Timing Source Selection
The line IO pins can use any input clock pin (RLCLKn or TCLKIn) or output clock pin (TLCLKn, RCLKOn, or
TCLKOn) for its clock pin and meet the AC timing specifications as long as the clock signal is valid for the mode the
part is in. The clock select bit for the transmit line IO signal group PORT.CR3.TLTS selects the correct input or
output clock timing.
10.2.3.1 Transmit Line Interface Pins Timing Source Selection
(TPOSn/TDATn, TNEGn)
The transmit line interface signal pin group has the same functional timing clock source as the TLCLKn pin
described in Table 10-3. Other clock pins can be used for the external timing. The TLCLKn transmit line clock
output pin is always a valid output clock for external logic to use for these signals when PORT.CR3.TLTS=0.
The transmit line timing select bit (TLTS) is used to select input or output clock pin timing. When TLTS=0, output
clock timing is selected. When TLTS=1, input clock timing is selected. If TLTS is set for input clock timing and an
output clock pin is used, or if TLTS is set for output clock timing and an input clock pin is used, then the setup, hold
and delay timings, as specified in Section 18.1 will not be valid. There are some combinations of TLTS=1 and other
modes in which there is no input clock pin available for external timing since the clock source is derived internally
from the RX LIU or the CLAD.
Table 10-6. Transmit Line Interface Signal Pin Valid Timing Source Select
LOOPT
LBM[2:0]
LIUEN
C
L
ADC
TLTS
Valid Timing to These Clock Pins
1
XXX
X
0
TLCLKn, TCLKOn, RCLKOn
1
XXX
0
X
1
RLCLKn
1
XXX
1
X
1
No valid timing to any input clock pin
0
DLB (100)
X
0
TLCLKn, TCLKOn, RCLKOn
0
LLB (010) or PLB (011)
X
0
TLCLKn, RCLKOn
0
DLB&LLB (110)
X
0
TLCLKn
0
not DLB (100),
not LLB (010), not PLB (011)
and not LLB&DLB (110)
X
0
TLCLKn, TCLKOn (default)
0
not LLB (010) and not PLB (011)
and not LLB&DLB (110)
X
0
1
No valid timing to any input clock pin
0
not LLB (010) and not PLB (011)
and not LLB&DLB (110)
X
1
TCLKIn
0
LLB (010) or PLB (011)
or DLB&LLB (110)
0
X
1
RLCLKn
0
LLB (010) or PLB (011)
or DLB&LLB (110)
1
X
1
No valid timing to any input clock pin
10.2.3.2 Transmit Framer Pin Timing Source Selection
(TSERn, TSOFIn, TSOFOn/TDENn)
The transmit framer signal pin group has the same functional timing clock source as the TCLKO pin described in
Table 10-4. Other clock pins can be used for the external timing. The TCLKO transmit clock output pin is always a
valid output clock for external logic to use for these signals when TFTS=0.
The transmit framer select bit (TFTS) is used to select input or output clock pin timing. When TFTS=0, output clock
timing is selected. When TFTS=1, input clock timing is selected. If TFTS is set for input clock timing and an output
clock pin is used, or If TFTS is set for output clock timing and an input clock pin is used, then the setup, hold and
delay timings, as specified in Section 18.1 will not be valid. There are some combinations of TFTS=1 and other
modes in which there is no input clock pin available for external timing since the clock source is derived internally
from the RX LIU or the CLAD.
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PDF描述 |
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| DS3173 | 功能描述:网络控制器与处理器 IC Triple DS3/E3 Single Chip Transceiver RoHS:否 制造商:Micrel 产品:Controller Area Network (CAN) 收发器数量: 数据速率: 电源电流（最大值）:595 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:PBGA-400 封装:Tray |
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