- 您现在的位置：买卖IC网 > Datasheet目录323 > DSP56311EVM (Freescale Semiconductor)KIT EVALUATION FOR DSP56311 Datasheet资料下载
参数资料
| 型号： | DSP56311EVM |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 39/360页 |
| 文件大小： | 0K |
| 描述： | KIT EVALUATION FOR DSP56311 |
| 标准包装： | 1 |
| 类型： | DSP |
| 适用于相关产品： | DSP56311 |
| 所含物品： | 模块板、安装指南、电源、缆线、软件等 |
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Enhanced Synchronous Serial Interface 0
Table 2-11. Enhanced Synchronous Serial Interface 0 (ESSI0) (Continued)
Signal
Name
SC01
Type
Input/Output
State During
Reset 1, 2
Ignored input
Serial Control 1
Signal Description
Functions in either Synchronous or Asynchronous mode. For Asynchronous
mode, this signal is the receiver frame sync I/O. For Synchronous mode, this
signal is either Transmitter 2 output or Serial I/O Flag 1.
PC1
Input or Output
Port C 1
The default configuration following reset is GPIO. For PC1, signal direction is
controlled through PRRC.
This signal is configured as SC01 or PC1 through PCRC. This input is 5 V
tolerant.
SC02
Input/Output
Ignored input
Serial Control Signal 2
The frame sync for both the transmitter and receiver in Synchronous mode,
and for the transmitter only in Asynchronous mode. When configured as an
output, this signal is the internally generated frame sync signal. When
configured as an input, this signal receives an external frame sync signal for
the transmitter (and the receiver in synchronous operation).
Port C 2
PC2
Input or Output
The default configuration following reset is GPIO. For PC2, signal direction is
controlled through PRRC. This signal is configured as SC02 or PC2 through
PCRC. This input is 5 V tolerant.
SCK0
Input/Output
Ignored input
Serial Clock
Provides the serial bit rate clock for the ESSI interface for both the transmitter
and receiver in Synchronous modes, or the transmitter only in Asynchronous
modes.
Although an external serial clock can be independent of and asynchronous to
the DSP system clock, it must exceed the minimum clock cycle time of 6 T
(that is, the system clock frequency must be at least three times the external
ESSI clock frequency). The ESSI needs at least three DSP phases inside
each half of the serial clock.
PC3
Input or Output
Port C 3
The default configuration following reset is GPIO. For PC3, signal direction is
controlled through PRRC. This signal is configured as SCK0 or PC3 through
PCRC. This input is 5 V tolerant.
SRD0
Input
Ignored input
Serial Receive Data
Receives serial data and transfers the data to the ESSI receive shift register.
SRD0 is an input when data is being received.
PC4
Input or Output
Port C 4
The default configuration following reset is GPIO. For PC4, signal direction is
controlled through PRRC. This signal is configured as SRD0 or PC4 through
PCRC. This input is 5 V tolerant.
STD0
Output
Ignored input
Serial Transmit Data
Transmits data from the serial transmit shift register. STD0 is an output when
data is being transmitted.
PC5
Input or Output
Port C 5
The default configuration following reset is GPIO. For PC5, signal direction is
controlled through PRRC. This signal is configured as STD0 or PC5 through
PCRC. This input is 5 V tolerant.
DSP56311 User’s Manual, Rev. 2
Freescale Semiconductor
2-13
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PDF描述 |
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参数描述 |
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| DSP56311FACT | 制造商:未知厂家 制造商全称:未知厂家 功能描述:DSP56311 Higher performance programmable DSP for demanding voice and data applications |
| DSP56311UM | 制造商:未知厂家 制造商全称:未知厂家 功能描述:DSP56311 24-Bit Digital Signal Processor Users Manual |
| DSP56311UMAD | 制造商:未知厂家 制造商全称:未知厂家 功能描述:DSP56311 Users Manual Addendum |
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