参数资料
型号: DSP56311EVM
厂商: Freescale Semiconductor
文件页数: 87/360页
文件大小: 0K
描述: KIT EVALUATION FOR DSP56311
标准包装: 1
类型: DSP
适用于相关产品: DSP56311
所含物品: 模块板、安装指南、电源、缆线、软件等
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Central Processor Unit (CPU) Registers
Table 4-3. Operating Mode Register (OMR) Bit Definitions (Continued)
Bit Number
9–8
Bit Name
CDP[1–0]
Reset Value
11
Core-DMA Priority
Description
Specify the priority of core and DMA accesses to the external bus.
00
01
10
11
Determined by comparing status register CP[1–0] to the
active DMA channel priority
DMA accesses have higher priority than core accesses
DMA accesses have the same priority as the core accesses
DMA accesses have lower priority than the core accesses
7
MS
0
Memory Switch Mode
Allows some internal data memory (X, Y, or both) to become part of the
chip internal Program RAM.
Notes: 1.
2.
To ensure proper operation, place six NOP instructions after
the instruction that changes the MS bit.
To ensure proper operation, do not set the MS bit while the
Instruction Cache is enabled (CE bit is set in SR).
6
SD
0
Stop Delay Mode
Determines the length of the delay invoked when the core exits the Stop
state. The STOP instruction suspends core processing indefinitely until a
defined event occurs to restart it. If SD is cleared, a 128K clock cycle
delay is invoked before a STOP instruction cycle continues. However, if
SD is set, the delay before the instruction cycle continues is 16 clock
cycles. The long delay allows a clock stabilization period for the internal
clock to begin oscillating and to stabilize. When a stable external clock is
used, the shorter delay allows faster start-up of the DSP56300 core.
5
0
Reserved. Write to zero for future compatibility.
4
EBD
0
External Bus Disable
Disables the external bus controller to reduce power consumption when
external memories are not used. When EBD is set, the external bus
controller is disabled and external memory cannot be accessed. When
EBD is cleared, the external bus controller is enabled and external access
can be performed. Hardware reset clears the EBD bit.
3–0
MD–MA
*
Chip Operating Mode
Indicate the operating mode of the DSP56300 core. On hardware reset,
these bits are loaded from the external mode select pins, MODD, MODC,
MODB, and MODA, respectively. After the DSP56300 core leaves the
Reset state, MD–MA can be changed under program control.
* The MD–MA bits reflect the corresponding value of the mode input (that is, MODD–MODA), respectively.
DSP56311 User’s Manual, Rev. 2
Freescale Semiconductor
4-13
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