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参数资料
| 型号： | DSP56F826BU80E |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 36/56页 |
| 文件大小： | 0K |
| 描述： | IC DSP 80MHZ 64KB FLASH 100LQFP |
| 标准包装： | 90 |
| 系列： | 56F8xx |
| 核心处理器： | 56800 |
| 芯体尺寸： | 16-位 |
| 速度： | 80MHz |
| 连通性： | EBI/EMI，SCI，SPI，SSI |
| 外围设备： | POR，WDT |
| 输入/输出数： | 46 |
| 程序存储器容量： | 67KB（33.5K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4.5K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 2.25 V ~ 2.75 V |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-LQFP |
| 包装： | 托盘 |
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Synchronous Serial Interface (SSI) Timing
56F826 Technical Data, Rev. 14
Freescale Semiconductor
41
Figure 3-24 Master Mode Timing Diagram
3. All the timings for the SSI are given for a non-inverted serial clock polarity (TSCKP=0 in SCR2 and RSCKP=0 in SCSR)
and a non-inverted frame sync (TFSI=0 in SCR2 and RFSI=0 in SCSR). If the polarity of the clock and/or the frame sync have
been inverted, all the timings remain valid by inverting the clock signal STCK/SRCK and/or the frame sync STFS/SRFS in the
tables and in the figures.
4. 50% duty cycle
5. bl = bit length; wl = word length
tTHM
tTSM
tHM
tSM
tRFSWLM
tRFSWHM
tRFBLM
tRFSBHM
tTXHIM
tTXNVM
tTXVM
tTXEM
tTFSWLM
tTFSWHM
tTFSBLM
tTFSBHM
tSCKL
tSCKW
tSCKH
First Bit
Last Bit
STCK output
STFS (bl) output
STFS (wl) output
STXD
SRCK output
SRFS (bl) output
SRFS (wl) output
SRXD
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PDF描述 |
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参数描述 |
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