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参数资料
| 型号： | DSP56F827FG80E |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 37/60页 |
| 文件大小： | 0K |
| 描述： | IC HYBRID CTRLR 16BIT 128-LQFP |
| 标准包装： | 72 |
| 系列： | 56F8xx |
| 核心处理器： | 56800 |
| 芯体尺寸： | 16-位 |
| 速度： | 80MHz |
| 连通性： | EBI/EMI，SCI，SPI，SSI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 64 |
| 程序存储器容量： | 136KB（68K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 5K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 2.25 V ~ 2.75 V |
| 数据转换器： | A/D 10x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 128-LQFP |
| 包装： | 托盘 |
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56F827 Technical Data, Rev. 12
42
Freescale Semiconductor
3.10 Analog-to-Digital Converter (ADC) Timing
Table 3-13 ADC Characteristics
Characteristic
Symbol
Min
Typ
Max
Unit
ADC Input voltage
VADCIN
0—
VREFHI1
1. VREF must be equal to or less than VDDA and must be greater than 2.7V. For optimal ADC performance, set VREF to
VDDA-0.3V.
V
Resolution
RES
12
—
12
Bits
Integral Non-Linearity2
INL
—
+/- 1
+/- 3
LSB3
Differential Non-Linearity
DNL
—
+/- 0.4
+/- 1
LSB3
Monotonicity
GUARANTEED
ADC internal clock4
fADIC
0.5
—
2.5
MHz
Conversion range
RAD
VREFLO
—VREFHI
V
Power-up time
tADPU
—25
—
ms
Conversion time
tADC
—6
—
tAIC cycles5
Sample time
tADS
—1
—
tAIC cycles5
Input capacitance
CADI
—5
—
pF5
Gain Error (transfer gain)4
EGAIN
0.95
1.00
1.10
—
Offset Voltage4
VOFFSET
-60
+15
+40
mV
Total Harmonic Distortion4
THD
57
66
—
dB
Effective Number of Bits4
ENOB
9.3
10.5
—
bit
Spurious Free Dynamic Range4
SFDR
58
70
—
dB
Signal-to-Noise plus Distortion4
SINAD
56
64
—
dB
ADC quiescent current
IADC
—
10
—
mA
ADC quiescent current (power
down bit set high)
IADCPD
—
1
—
μA
VREF quiescent current
IVREF
—
1
—
mA
VREF quiescent current (power
down bit set high)
IVREFPD
—
1
—
μA
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