- 您现在的位置：买卖IC网 > PDF目录16057 > EF-ISE-LOG-FL (Xilinx Inc)DESIGN SUITE LOGIC EDITION PDF资料下载
参数资料
| 型号： | EF-ISE-LOG-FL |
| 厂商： | Xilinx Inc |
| 文件页数： | 27/50页 |
| 文件大小： | 0K |
| 描述： | DESIGN SUITE LOGIC EDITION |
| 标准包装： | 1 |
| 系列： | ISE® 设计套件 |
| 类型： | 集成软件环境（ISE） |
| 适用于相关产品： | Xilinx FPGAs |
| 其它名称： | Q5689019A |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页当前第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页
ISE Design Suite 13.1
New Blocks
Complex Multiply 5.0
This block is based on the Xilinx? LogiCORE? IP Complex Multiplier that implements
AXI4-Stream compliant, high performance, optimized complex multipliers based on user-
specified options.
DSP48 Macro 2.1
The Xilinx LogiCORE? DSP48 Macro provides an easy-to-use interface that abstracts the
XtremeDSP? slice and simplifies its dynamic operation by enabling the specification of
multiple operations via a set of user-defined arithmetic expressions. New in this version of
the core is the ability to control resets and clock enables of the registers within the
XtremeDSP Slice.
DSP48E1
The Xilinx DSP48E1 block is an efficient building block for DSP applications that use Xilinx
Virtex?-6 devices. The DSP48E1 block provides access to the pre-added and control of the
registers within the silicon.
FIR Compiler 6.2
This block is based on the Xilinx? LogiCORE? IP FIR Compiler v6.2 that implements
AXI4-Stream compliant, high performance, optimized complex multipliers based on user-
specified options.
VDMA Interface 3.0 (Beta)
This block is based on the AXI Video Direct Memory Access (AXI VDMA) core which is a
soft Xilinx IP core providing high-bandwidth direct memory access between external DDR
memory and the AXI4-Stream interface. Initialization, status, and management registers
are accessed through an AXI4-Lite slave interface which can be configured using an
MCode block. A MATLAB utility function is provided to generate the necessary logic to
easily connect your System Generator design to external DDR memory.
Previous Versions of System Generator for DSP Release Notes
Previous versions of System Generator for DSP release notes are located in Chapter 3 of the
System Generator for DSP Getting Started Guide (v 12.4) . This getting started guide is
located online at the following URL:
ISE Design Suite 13: Release Notes Guide
UG631 (v 13.2)
27
相关PDF资料 |
PDF描述 |
|---|---|
| VE-JVN-EZ-F4 | CONVERTER MOD DC/DC 18.5V 25W |
| VE-JVM-EZ-F2 | CONVERTER MOD DC/DC 10V 25W |
| VE-JVM-EY-S | CONVERTER MOD DC/DC 10V 50W |
| VE-JVL-EZ-F3 | CONVERTER MOD DC/DC 28V 25W |
| M3BFK-4018J | IDC CABLE - MSR40K/MC40G/MCF40K |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EF-ISE-LOG-NL | 功能描述:DESIGN SUITE LOGIC EDITION ISE12 RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-SYSTEM-FL | 功能描述:ISE DESIGN SYST FLOATING LICENSE RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EF-ISE-SYSTEM-NL | 功能描述:SOFTWARE ISE SYS EDITION RoHS:是 类别:编程器，开发系统 >> 软件 系列:ISE® 设计套件 标准包装:1 系列:ISE® 设计套件 类型:订阅 适用于相关产品:Xilinx FPGAs 其它名称:Q4986209T1081384 |
| EFJ02-001M | 制造商:Black Box Corporation 功能描述:TOSLINK TO MINI PLUG PATCH COR |
| EFJ04-001M | 制造商:Black Box Corporation 功能描述:PREMIUM GRADE DIGITAL OPTICAL CABLE 1 METER |
发布紧急采购，3分钟左右您将得到回复。