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参数资料
| 型号： | EPF10K200S |
| 英文描述： | Programmable Logic |
| 中文描述： | 可编程逻辑 |
| 文件页数： | 92/138页 |
| 文件大小： | 2116K |
| 代理商： | EPF10K200S |
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Altera Corporation
57
FLEX 10K Embedded Programmable Logic Family Data Sheet
tCO
LE register clock-to-output delay
tCOMB
Combinatorial delay
tSU
LE register setup time for data and enable signals before clock; LE register
recovery time after asynchronous clear, preset, or load
tH
LE register hold time for data and enable signals after clock
tPRE
LE register preset delay
tCLR
LE register clear delay
tCH
Minimum clock high time from clock pin
tCL
Minimum clock low time from clock pin
Table 33. IOE Timing Microparameters
Symbol
Parameter
Conditions
tIOD
IOE data delay
tIOC
IOE register control signal delay
tIOCO
IOE register clock-to-output delay
tIOCOMB
IOE combinatorial delay
tIOSU
IOE register setup time for data and enable signals before clock; IOE register
recovery time after asynchronous clear
tIOH
IOE register hold time for data and enable signals after clock
tIOCLR
IOE register clear time
tOD1
Output buffer and pad delay, slow slew rate = off, VCCIO = VCCINT
C1 = 35 pF
tOD2
Output buffer and pad delay, slow slew rate = off, VCCIO = low voltage
C1 = 35 pF
tOD3
Output buffer and pad delay, slow slew rate = on
C1 = 35 pF
tXZ
IOE output buffer disable delay
tZX1
IOE output buffer enable delay, slow slew rate = off, VCCIO = VCCINT
C1 = 35 pF
tZX2
IOE output buffer enable delay, slow slew rate = off, VCCIO = low voltage
C1 = 35 pF
tZX3
IOE output buffer enable delay, slow slew rate = on
C1 = 35 pF
tINREG
IOE input pad and buffer to IOE register delay
tIOFD
IOE register feedback delay
tINCOMB
IOE input pad and buffer to FastTrack Interconnect delay
Table 32. LE Timing Microparameters (Part 2 of 2)
Note (1)
Symbol
Parameter
Conditions
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PDF描述 |
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