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参数资料
| 型号： | HW-V5-ML555-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 67/108页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR VIRTEX-5 ML555 |
| 产品培训模块： | PCI Express and Virtex® -5 FPGAs |
| 标准包装： | 1 |
| 系列： | Virtex® -5 |
| 类型： | FPGA |
| 适用于相关产品： | Virtex?-5 FPGA |
| 所含物品： | 板，线缆，CD |
| 配用： | HW-AFX-SMA-SFP-ND - CONVERSION MODULE SMA - SFP HW-AFX-SMA-SATA-ND - CONVERSION MODULE SMA - SATA HW-AFX-SMA-RJ45-ND - CONVERSION MODULE SMA - RJ45 HW-AFX-SMA-HSSDC2-ND - CONVERSION MODULE SMA - HSSDC2 HW-AFX-BERG-EPHY-ND - DAUGHTER CARD PHY BERG-EPHY |
| 相关产品： | XC5VFX70T-1FF1136CES-ND - IC FPGAVIRTEX5FX ES 70K 1136FBGA XC5VLX85T-3FF1136C-ND - IC FPGA VIRTEX-5 85K 1136FBGA XC5VLX85T-2FF1136I-ND - IC FPGA VIRTEX-5 85K 1136FBGA XC5VLX85T-2FF1136C-ND - IC FPGA VIRTEX-5 85K 1136FBGA XC5VLX85T-1FF1136I-ND - IC FPGA VIRTEX-5 85K 1136FBGA XC5VLX85T-1FF1136C-ND - IC FPGA VIRTEX-5 85K 1136FBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-1FF1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA 更多... |
| 其它名称： | 122-1586 HW-V5-ML555-G-ND |
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R
Clock Generation
the switch positions assigned for the M and N constants. When the switch is in the ON
position, a logic “1” is obtained, and in the OFF position, a logic “0” is obtained.
positions are used for the M and N input values to the clock synthesizers. When the switch
is in the OFF position a logic 0 is selected. When the switch is not in the OFF position, a
logic 1 is selected. ICS1 input N1 is located on SW12 position 8. Figure 3-12 shows two
examples: one with ICS1 generating a 330 MHz clock and the other with ICS2 generating a
150 MHz clock.
Table 3-24:
M and N Constant Values Set Through ML555 DIP Switch Configuration
Switch Position
Parallel Load Pushbutton (1)
N1
N0
M8
M7
M6
M5
M4
M3
M2
M1
M0
Synthesizer Circuit 1
SW9
SW12 pins 8-9
SW10 pins 8-9
Tied to logic 0
Tied to logic 0
SW10 pins 7-10
SW10 pins 6-11
SW10 pins 5-12
SW10 pins 4-13
SW10 pins 3-14
SW10 pins 2-15
SW10 pins 1-16
Synthesizer Circuit 2
SW11
SW12 pins 7-10
SW12 pins 6-11
Tied to logic 0
Tied to logic 0
Tied to logic 0
Tied to logic 0
SW12 pins 5-12
SW12 pins 4-13
SW12 pins 3-14
SW12 pins 2-15
SW12 pins 1-16
Notes:
1. The parallel load pushbutton switch must be pressed and released to perform a parallel load of the
synthesizer. Alternatively, the FPGA PLOAD1 or PLOAD2 output can be asserted and deasserted to
perform a parallel load without having to press and release the pushbutton switch associated with the
clock synthesizer.
Virtex-5 FPGA ML555 Development Kit
UG201 (v1.4) March 10, 2008
67
相关PDF资料 |
PDF描述 |
|---|---|
| HW-V5-ML561-UNI-G | EVALUATION PLATFORM VIRTEX-5 |
| I-JET | JTAG ARM DEBUGGING PROBE |
| IAC24A | INPUT MODULE AC 5MA 24VDC |
| IAC5EQ | INPUT MODULE AC 10MA 5VDC |
| IB8RM | SURGE SUPP 8OUT 12'CORD W/REMOTE |
相关代理商/技术参数 |
参数描述 |
|---|---|
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| HW-VID-KIT | 功能描述:可编程逻辑 IC 开发工具 Lattice Video Interface Kit RoHS:否 制造商:Altera Corporation 产品:Development Kits 类型:FPGA 工具用于评估:5CEFA7F3 接口类型: 工作电源电压: |
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