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参数资料
| 型号： | IBIS4-A-6600 |
| 厂商： | Cypress Semiconductor Corp. |
| 英文描述： | 6.6 MP CMOS Image Sensor |
| 中文描述： | 6.6万像素的CMOS图像传感器 |
| 文件页数： | 27/40页 |
| 文件大小： | 1698K |
| 代理商： | IBIS4-A-6600 |
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IBIS4-A-6600
CYII4SM6600AB
ADVANCE
INFORMATION
Document Number: 001-02366 Rev. *D
Page 27 of 40
Figure 20. Basic Frame and Line Timing
Pixel Output Timing
Using Two Analog Outputs
Figure 21. Pixel Output Timing using Two Analog Outputs
The pixel signal at the OUT1 (OUT2) output becomes valid
after 4 SYS_CLOCK cycles when the internal X_SYNC (= start
of PIXEL_VALID output) has appeared (see Figure 21.). The
PIXEL_VALID and EOL/EOF pulses can be delayed by the
user through the DELAY register.
T1 ..................................Row blanking time (see Table 17. )
T2 ..................................................... 4 SYS_CLOCK cycles.
Multiplexing to One Analog Output
The pixel signal at the OUT1 output becomes valid after 5
SYS_CLOCK cycles when the internal X_SYNC (= start of
PIXEL_VALID output) has appeared (see Figure 22.). The
PIXEL_VALID and EOL/EOF pulses can be delayed by the
user through the DELAY register.
T1 .............................................................Row blanking time
T2 ......................................................5 SYS_CLOCK cycles.
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PDF描述 |
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参数描述 |
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