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参数资料
| 型号： | ICS93727YFLF-T |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 10 INVERTED OUTPUT(S), PDSO48 |
| 封装： | 0.300 INCH, SSOP-48 |
| 文件页数： | 4/9页 |
| 文件大小： | 109K |
| 代理商： | ICS93727YFLF-T |
4
ICS93727
Preliminary Product Preview
0711B—10/10/02
I
2C Table: Step Delay Control Register
Pin #
Name
PWD
Bit 7
-
R/W
0
Bit 6
-
R/W
0
Bit 5
-
R/W
0
Bit 4
-
R/W
0
Bit 3
-
R/W
0
Bit 2
-
R/W
0
Bit 1
-
R/W
0
Bit 0
-
R/W
0
I
2C Table: Output Control Register
Pin #
Name
0
1
PWD
Bit 7
2, 3
DDRC0, DDRT0
Output Enable
R/W
Stop
Run
1
Bit 6
5, 6
DDRC1, DDRT1
Output Enable
R/W
Stop
Run
1
Bit 5
9, 10
DDRC2, DDRT2
Output Enable
R/W
Stop
Run
1
Bit 4
19, 20
DDRC3, DDRT3
Output Enable
R/W
Stop
Run
1
Bit 3
22, 23
DDRC4, DDRT4
Output Enable
R/W
Stop
Run
1
Bit 2
27,26
DDRC9, DDRT9
Output Enable
R/W
Stop
Run
1
Bit 1
-
(reserved)
R/W
-
1
Bit 0
-
(reserved)
R/W
-
1
I
2C Table: Output Control Register
Pin #
Name
0
1
PWD
Bit 7
-
(reserved)
R/W
-
1
Bit 6
-
(reserved)
R/W
-
1
Bit 5
-
(reserved)
R/W
-
1
Bit 4
30, 29
DDRC8, DDRT8
Output Enable
R/W
Stop
Run
1
Bit 3
40, 39
DDRC7, DDRT7
Output Enable
R/W
Stop
Run
1
Bit 2
44, 43
DDRC6, DDRT6
Output Enable
R/W
Stop
Run
1
Bit 1
47, 46
DDRC5, DDRT5
Output Enable
R/W
Stop
Run
1
Bit 0
-
(reserved)
R/W
-
1
I
2C Table: Reserved Register
Pin #
Name
0
1
PWD
Bit 7
-
(reserved)
R/W
-
1
Bit 6
-
(reserved)
R/W
-
1
Bit 5
-
(reserved)
R/W
-
1
Bit 4
-
(reserved)
R/W
-
1
Bit 3
-
(reserved)
R/W
-
1
Bit 2
-
(reserved)
R/W
-
1
Bit 1
-
(reserved)
R/W
-
1
Bit 0
-
(reserved)
R/W
-
1
BYTE
4
Affected Pin
Control Function
BYTE
7
Affected Pin
Control Function
BYTE
5
Affected Pin
Control Function
BYTE
6
Step Delay Skew Programming for
DDR 9 Outputs
SEE TABLE 2
Type
Bit Control
Type
Bit Control
Affected Pin
Control Function
Type
Bit Control
Step Delay Skew Programming for
DDR (8:0) Outputs
SEE TABLE 2
Bit Control
Type
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PDF描述 |
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