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参数资料
| 型号： | IDT72V3612L15PQF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | FIFO |
| 英文描述： | 3.3 VOLT CMOS SyncBiFIFO-TM 64 x 36 x 2 |
| 中文描述： | 64 X 36 BI-DIRECTIONAL FIFO, 10 ns, PQFP132 |
| 封装： | PLASTIC, QFP-132 |
| 文件页数： | 15/25页 |
| 文件大小： | 240K |
| 代理商： | IDT72V3612L15PQF |
22
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
Figure 17. ODD/
EVEN W/RA, MBA, and PGA to PEFA Timing
NOTE:
1. Port A parity generation off (PGA = LOW).
Figure 16. Timing for Mail2 Register and
MBF2 Flag
NOTE:
1. ENA is HIGH, and
CSA is LOW.
4659 drw 19
CLKB
ENB
B0 - B35
MBB
CSB
W/
RB
CLKA
MBF2
CSA
MBA
ENA
A0 - A35
W/
RA
W1
tENS1
tENH1
tDS
tDH
tPMF
tENS2
tENH2
tDIS
tEN
tMDV
tPMR
FIFO2 Output Register
W1 (Remains valid in Mail2 Register after read)
tENS1
tENH1
tENS1
tENH1
tENS1
tENH1
4659 drw 20
ODD/
EVEN
PEFA
PGA
MBA
W/
RA
Valid
tPOPE
tPEPE
tPOPE
tPEPE
相关PDF资料 |
PDF描述 |
|---|---|
| IDT72V3612L20PF | 3.3 VOLT CMOS SyncBiFIFO-TM 64 x 36 x 2 |
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