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参数资料
| 型号： | IDT72V3612L15PQF |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | FIFO |
| 英文描述： | 3.3 VOLT CMOS SyncBiFIFO-TM 64 x 36 x 2 |
| 中文描述： | 64 X 36 BI-DIRECTIONAL FIFO, 10 ns, PQFP132 |
| 封装： | PLASTIC, QFP-132 |
| 文件页数： | 8/25页 |
| 文件大小： | 240K |
| 代理商： | IDT72V3612L15PQF |
16
IDT72V3612 3.3V, CMOS SyncBiFIFOTM
64 x 36 x 2
COMMERCIALTEMPERATURERANGE
NOTE:
1. tSKEW1 is the minimum time between a rising CLKA edge and a rising CLKB edge for
EFB to transition HIGH in the next CLKB cycle. If the time between the rising CLKA edge and
rising CLKB edge is less than tSKEW1, then the transition of
EFB HIGH may occur one CLKB cycle later than shown.
Figure 7.
EFB Flag Timing and First Data Read when FIFO1 is Empty
CSA
W/
RA
MBA
FFA
A0 - A35
CLKB
EFB
CSB
W/
RB
MBB
ENA
ENB
B0 -B35
CLKA
12
4659 drw 10
tCLKH
tCLKL
tCLK
tENS3
tENS2
tENH3
tENH2
tDS
tDH
tSKEW1
tCLK
tCLKL
tENS2
tENH2
tA
W1
FIFO1 Empty
LOW
HIGH
LOW
tCLKH
W1
HIGH
(1)
tREF
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PDF描述 |
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