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参数资料
| 型号： | IDT79RC32H434-266BCG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 22/53页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 266MHZ 256-BGA |
| 标准包装： | 90 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 266MHz |
| 电压： | 1.2V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 79RC32H434-266BCG |
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January 19, 2006
IDT RC32434
Figure 13 PCI AC Timing Waveform — PCI Reset in Satellite Mode
Signal
Symbol Reference
Edge
266MHz 300MHz 350MHz 400MHz
Unit Conditions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
I2C1
SCL
Frequency none
0
100
0
100
0
100
0
100
kHz
100 KHz
See Figure 14.
Thigh_12a,
Tlow_12a
4.0
—
4.0
—
4.0
—
4.0
—
s
Trise_12a
—
1000
—
1000
—
1000
—
1000
ns
Tfall_12a
—
300
—
300
—
300
—
300
ns
SDA
Tsu_12b
SCL rising
250
—
250
—
250
—
250
—
ns
Thld_12b
0
3.45
0
3.45
0
3.45
0
3.45
s
Trise_12b
—
1000
—
1000
—
1000
—
1000
ns
Tfall_12b
—
300
—
300
—
300
—
300
ns
Start or repeated start
condition
Tsu_12c
SDA falling
4.7
—
4.7
—
4.7
—
4.7
—
s
Thld_12c
4.0
—
4.0
—
4.0
—
4.0
—
s
Stop condition
Tsu_12d
SDA rising
4.0
—
4.0
—
4.0
—
4.0
—
s
Bus free time between
a stop and start condi-
tion
Tdelay_12e
4.7
—
4.7
—
4.7
—
4.7
—
s
SCL
Frequency none
0
400
0
400
0
400
0
400
kHz
400 KHz
Thigh_12a,
Tlow_12a
0.6
—
0.6
—
0.6
—
0.6
—
s
Trise_12a
—
300
—
300
—
300
—
300
ns
Tfall_12a
—
300
—
300
—
300
—
300
ns
SDA
Tsu_12b
SCL rising
100
—
100
—
100
—
100
—
ns
Thld_12b
0
0.9
0
0.9
0
0.9
0
0.9
s
Trise_12b
—
300
—
300
—
300
—
300
ns
Tfall_12ba
—
300
—
300
—
300
—
300
ns
Table 11 I2C AC Timing Characteristics (Part 1 of 2)
Tdz_10e
Tpw_10e
warm reset
CLKP
PCIRSTN (input)
RSTN
MDATA[15:0]
PCI bus signals
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