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参数资料
| 型号： | IDT82V3358EDG |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 72/139页 |
| 文件大小： | 0K |
| 描述： | IC PLL WAN SYNC ETHERNET 64TQFP |
| 标准包装： | 160 |
| 类型： | 时钟/频率发生器，多路复用器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH，Stratum |
| 输入： | CMOS，LVDS，PECL |
| 输出： | CMOS，LVDS，PECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 622.08MHz |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-TQFP 裸露焊盘 |
| 供应商设备封装： | 64-TQFP-EP（10x10） |
| 包装： | 托盘 |
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IDT82V3358
SYNCHRONOUS ETHERNET WAN PLL
Functional Description
38
May 19, 2009
Table 27: Outputs on OUT3 & 4 if Derived from T4 APLL
OUTn_DIVIDER[3:0
] (Output Divider) 1
outputs on
OUT3 & 4 if derived from T4 APLL output 2
77.76 MHz X 4
12E1 X 4
16E1 X 4
24T1 X 4
16T1 X 4
E3
T3
GSM
(26 MHz X 2)
OBSAI
(30.72 MHz X 10)
GPS
(40 MHz)
0000
Output is disabled (output low).
0001
0010
48E1
64E1
96T1
64T1
E3
T3
52 MHz
0011
155.52 MHz
24E1
32E1
48T1
32T1
26 MHz
153.6 MHz
20 MHz
0100
77.76 MHz
12E1
16E1
24T1
16T1
13 MHz
76.8 MHz
10 MHz
0101
51.84 MHz
8E1
16T1
0110
38.88 MHz
6E1
8E1
12T1
8T1
38.4 MHz
5 MHz
0111
25.92 MHz
4E1
8T1
1000
19.44 MHz
3E1
4E1
6T1
4T1
1001
2E1
4T1
1010
2E1
3T1
2T1
1011
6.48 MHz
E1
2T1
1100
E1
T1
1101
T1
1110
1111
Output is disabled (output high).
Note:
1. n = 3, 4. Each output is assigned a frequency divider.
2. In the APLL, the selected T0/T4 DPLL output may be multiplied. E1 = 2.048 MHz, T1 = 1.544 MHz, E3 = 34.368 MHz, T3 = 44.736 MHz. The blank cell means the configuration is
reserved.
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参数描述 |
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