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参数资料
| 型号： | MC35XS3400DPNAR2 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 31/46页 |
| 文件大小： | 0K |
| 描述： | IC SWITCH HIGH SIDE QUAD 24QFN |
| 标准包装： | 1,200 |
| 类型： | 高端开关 |
| 输出数： | 4 |
| Rds（开）： | 35 毫欧 |
| 内部开关： | 是 |
| 电流限制： | 6A |
| 输入电压： | 6 V ~ 20 V |
| 工作温度： | -40°C ~ 125°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-PowerQFN |
| 供应商设备封装： | 24-PQFN（12x12） |
| 包装： | 带卷 (TR) |
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FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
Table 15. Current Sense Ratio Selection
Table 18. Output Steady State Selection
0
1
CRS0 (default)
CRS1
0
1
1
0
OCLO3
OCLO4
ADDRESS A 1 A 0 100 — OUTPUT OVER-CURRENT
REGISTER (OCR)
The OCR_s register allows the MCU to configure
corresponding output over-current protection through the
SPI. Each output “s” is independently selected for
configuration based on the state of the D14 : D13 bits
1 1 OCLO1
Bit D0 (OC_mode_sel) allows to select the over-current
Table 19. Over-current Mode Selection
OC_mode_s (D0) Over-current Mode
D[7:6] bits allow to MCU to programmable bulb cooling
curve and D[5:4] bits inrush curve for selected output, as
0
1
only inrush current management (default)
inrush current and bulb cooling management
Table 16. Cooling and Inrush Curve Selection
BC1_s (D7) BC0_s (D6) Profile Curves Speed
ADDRESS 00101 — GLOBAL CONFIGURATION
REGISTER (GCR)
The GCR register allows the MCU to configure the device
through the SPI.
0
0
1
1
0
1
0
1
medium (default)
slow
fast
medium
Bit D8 allows the MCU to enable or disable the V DD failure
detector. A logic [1] on VDD_FAIL_en bit allows transitioning
to Fail-safe mode for V DD < V DD(FAIL).
Bit D7 allows the MCU to enable or disable the PWM
module. A logic [1] on PWM_en bit allows control of the
Table 17. Inrush Curve Selection
outputs HS[0:3] with PWMR register (the direct input states
are ignored).
OC1_s (D5)
0
0
1
OC0_s (D4)
0
1
0
Profile Curves Speed
slow (default)
fast
medium
Bit D6 (CLOCK_sel) allows to select the clock used as
reference by PWM module, as described in the following
Table 20. PWM Module Selection
1
1
very slow
PWM_en (D7) CLOCK_sel (D6)
PWM module
A logic [1] on bit D3 (OCHI_s bit) the OCHI1 level is
0
1
X
0
PWM module disabled
(default)
PWM module enabled with
external clock from IN0
1
1
PWM module enabled with
t OC1 t OC3 t
t OC5
t OC7
t OC6
t OC2
CSNS reporting
I OCH1
I OCH2
I OC1
I OC2
I OC3
I OC4
I OCLO4
I OCLO3
I OCLO2
I OCLO1
Time
OC4
Figure 13. Over-current profile with OCHI bit set to ‘1’
The wire harness is protected by one of four possible
internal calibrated clock
Bits D5:D4 allow the MCU to select one of two analog
Table 21. CSNS Reporting Selection
TEMP_en CSNS_en
(D5) (D4)
0 0 CSNS tri-stated (default)
X 1 current recopy of selected output (D3:2]
bits)
1 0 temperature on GND flag
Table 22. Output Current Recopy Selection
Table 18. Output Steady State Selection
CSNS1 (D3)
CSNS0 (D2)
CSNS reporting
OCLO1 (D2) OCLO0 (D1)
Steady State Current
0
0
HS0 (default)
0
0
OCLO2 (default)
0
1
HS1
35XS3400
Analog Integrated Circuit Device Data ?
Freescale Semiconductor
31
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