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参数资料
| 型号： | MC56F8246VLF |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 54/88页 |
| 文件大小： | 0K |
| 描述： | DSC 48K FLASH 60MHZ 48-LQFP |
| 标准包装： | 250 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 60MHz |
| 连通性： | CAN，I²C，LIN，SCI，SPI |
| 外围设备： | LVD，POR，PWM，WDT |
| 输入/输出数： | 39 |
| 程序存储器容量： | 48KB（24K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 3K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 10x12b，D/A 1x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 48-LQFP |
| 包装： | 管件 |
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MC56F825x/MC56F824x Digital Signal Controller, Rev. 3
Specifications
Freescale Semiconductor
58
Figure 17. External Clock Timing
7.14
Phase Locked Loop Timing
External clock input rise time4
trise
——
3
ns
External clock input fall time5
tfall
——
3
ns
Input high voltage overdrive by an external clock
Vih
0.85VDD
——
V
Input high voltage overdrive by an external clock
Vil
——
0.3VDD
V
1 Parameters listed are guaranteed by design.
2 See Figure 17 for details on using the recommended connection of an external clock driver.
3 The chip may not function if the high or low pulse width is smaller than 6.25 ns.
4 External clock input rise time is measured from 10% to 90%.
5 External clock input fall time is measured from 90% to 10%.
Table 30. Phase Locked Loop Timing
Characteristic
Symbol
Min
Typ
Max
Unit
PLL input reference frequency1
1 An externally supplied reference clock should be as free as possible from any phase jitter for the PLL to work correctly. The
PLL is optimized for 8 MHz input.
fref
48
8
MHz
PLL output frequency2
2 The core system clock operates at 1/6 of the PLL output frequency.
fop
120
—
240
MHz
PLL lock time3 4
3 This is the time required after the PLL is enabled to ensure reliable operation.
4 From powerdown to powerup state at 60 MHz system clock state.
tplls
—40
100
s
Accumulated jitter using an 8 MHz external crystal as the PLL source5
5 This is measured on the CLKO signal (programmed as system clock) over 264 system clocks at 60 MHz system clock
frequency and using an 8 MHz oscillator frequency.
JA
——
TBD
%
Cycle-to-cycle jitter
tjitterpll
—350
—
ps
Table 29. External Clock Operation Timing Requirements1 (continued)
Characteristic
Symbol
Min
Typ
Max
Unit
90%
50%
10%
90%
50%
10%
External
Clock
tPW
tfall
trise
VIL
VIH
Note: The midpoint is VIL + (VIH – VIL)/2.
相关PDF资料 |
PDF描述 |
|---|---|
| S9S12P96J0MFT | MCU 96K FLASH AUTO 48-QFN |
| S9S12P64J0MQK | MCU 64K FLASH AUTO 80-QFP |
| S9S12P64J0MLH | MCU 64K FLASH AUTO 64-LQFP |
| VI-2ND-IX-S | CONVERTER MOD DC/DC 85V 75W |
| VI-2NB-IY-B1 | CONVERTER MOD DC/DC 95V 50W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC56F8247 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Digital Signal Controller Battery chargers and management |
| MC56F8247MLH | 功能描述:数字信号处理器和控制器 - DSP, DSC DSC 64 LQFP 48K FL RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| MC56F8247VLH | 功能描述:数字信号处理器和控制器 - DSP, DSC DSC 64 LQFP 48K FL RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| MC56F8247VLHR | 制造商:Freescale Semiconductor 功能描述:MICRO CONTROLLER |
| MC56F824X | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Digital Signal Controller Battery chargers and management |
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