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参数资料
| 型号： | MC56F8323VFBE |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 131/140页 |
| 文件大小： | 0K |
| 描述： | IC MPU HYBRID DSP 32K 64-LQFP |
| 标准包装： | 160 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 60MHz |
| 连通性： | CAN，SCI，SPI |
| 外围设备： | POR，PWM，温度传感器，WDT |
| 输入/输出数： | 27 |
| 程序存储器容量： | 32KB（16K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 12K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.25 V ~ 3.6 V |
| 数据转换器： | A/D 8x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 托盘 |
| 配用： | MC56F8323EVME-ND - BOARD EVALUATION MC56F8323 |
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56F8323 Technical Data, Rev. 17
90
Freescale Semiconductor
Preliminary
6.5.6.3
IRQ—Bit 10
This bit controls the pull-up resistors on the IRQA pin.
6.5.6.4
Reserved—Bits 9–4
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.6.5
JTAG—Bit 3
This bit controls the pull-up resistors on the TRST, TMS, and TDI pins.
6.5.6.6
Reserved—Bits 2–0
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.7
CLKO Select Register (SIM_CLKOSR)
The CLKO select register can be used to multiplex out any one of the clocks generated inside the clock
generation and SIM modules. The default value is SYS_CLK. All other clocks primarily muxed out are
for test purposes only, and are subject to significant unspecified latencies at high frequencies.
The upper four bits of the GPIOB register can function as GPIO, Quad Decoder #0 signals, or as additional
clock output signals. GPIO has priority and is enabled/disabled via the GPIOB_PER. If GPIOB[7:4] are
programmed to operate as peripheral outputs, then the choice between Quad Decoder #0 and additional
clock outputs is made here in the CLKOSR. The default state is for the peripheral function of GPIOB[7:4]
to be programmed as Quad Decoder #0. This can be changed by altering PHASE0 through INDEX shown
in Figure 6-9.
The CLKOUT pin is not bonded out in the device. Instead, it is offered only as a pad for die-level testing.
Figure 6-9 CLKO Select Register (SIM_CLKOSR)
6.5.7.1
Reserved—Bits 15–10
This bit field is reserved or not implemented. It is read as 0 and cannot be modified by writing.
6.5.7.2
PHASEA0 (PHSA)—Bit 9
0 = Peripheral output function of GPIOB[7] is defined to be PHASEA0
1 = Peripheral output function of GPIOB[7] is defined to be the oscillator clock (MSTR_OSC, see
6.5.7.3
PHASEB0 (PHSB)—Bit 8
0 = Peripheral output function of GPIOB[6] is defined to be PHASEB0
1 = Peripheral output function of GPIOB[6] is defined to be SYS_CLK2
Base + $A
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
PHSA PHSB
INDEX
HOME
CLK
DIS
CLKOSEL
Write
RESET
000000
0
1
0
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| MC56F8335VFG60 | 制造商:Freescale Semiconductor 功能描述:16 BIT HYBRID CONTROLLER - Trays |
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