参数资料
型号: MC68306FC16B
厂商: Freescale Semiconductor
文件页数: 137/191页
文件大小: 0K
描述: IC MPU INTEGRATED 132-PQFP
标准包装: 36
系列: M683xx
处理器类型: M683xx 32-位
速度: 16MHz
电压: 5V
安装类型: 表面贴装
封装/外壳: 132-BQFP 缓冲式
供应商设备封装: 132-PQFP(24.13x24.13)
包装: 托盘
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vi
MC68306 USER'S MANUAL
MOTOROLA
TABLE OF CONTENTS (Continued)
Paragraph
Page
Number
Title
Number
2.3 DRAM Controller Signals........................................................................................ 2-9
2.3.1 Column Address Strobe (CAS1– CAS0 )............................................................... 2-9
2.3.2 Row Address Strobe (RAS1 –RAS0) .................................................................... 2-9
2.3.3 DRAM Write Signal (DRAMW) ............................................................................. 2-9
2.4 Interrupt Control and Parallel Port Signals ............................................................. 2-9
2.4.1 Interrupt Request (IRQ7–IRQ1) ........................................................................... 2-9
2.4.2 Interrupt Acknowledge (IACK7–IACK1) ............................................................... 2-9
2.4.3 Port A Signals (PA7–PA0) ................................................................................... 2-9
2.4.4 Port B (PB7–PB0) ................................................................................................ 2-9
2.5 Clock and Mode Control Signals ............................................................................ 2-10
2.5.1 Crystal Oscillator (EXTAL, XTAL) ........................................................................ 2-10
2.5.2 Clock Out (CLKOUT) ........................................................................................... 2-10
2.5.3 Address Mode (AMODE) ..................................................................................... 2-10
2.6 Serial Module Signals ............................................................................................. 2-10
2.6.1 Channel A Receiver Serial-Data Input (RxDA) .................................................... 2-10
2.6.2 Channel A Transmitter Serial-Data Output (TxDA) ............................................. 2-10
2.6.3 Channel B Receiver Serial-Data Input (RxDB) .................................................... 2-10
2.6.4 Channel B Transmitter Serial-Data Output (TxDB) ............................................. 2-10
2.6.5 CTSA ................................................................................................................... 2-11
2.6.6 RTSA ................................................................................................................... 2-11
2.6.7 CTSB ................................................................................................................... 2-11
2.6.8 RTSB ................................................................................................................... 2-11
2.6.9 Crystal Oscillator (X1, X2) ................................................................................... 2-11
2.6.10 IP2 ..................................................................................................................... 2-11
2.6.11 OP3 ................................................................................................................... 2-11
2.7 JTAG Port Test Signals .......................................................................................... 2-11
2.7.1 Test Clock (TCK) ................................................................................................. 2-12
2.7.2 Test Mode Select (TMS)...................................................................................... 2-12
2.7.3 Test Data In (TDI) ................................................................................................ 2-12
2.7.4 Test Data Out (TDO) ........................................................................................... 2-12
2.7.5 Test Reset (TRST) .............................................................................................. 2-12
Section 3
68000 Bus Operation Description
3.1 Data Transfer Operations ....................................................................................... 3-1
3.1.1 Read Cycle .......................................................................................................... 3-1
3.1.2 Write Cycle .......................................................................................................... 3-4
3.1.3 Read-Modify-Write Cycle..................................................................................... 3-7
3.1.4 CPU Space Cycle ................................................................................................ 3-11
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I
Freescale Semiconductor, Inc.
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PDF描述
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