参数资料
| 型号： | MC68306FC16B |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 80/191页 |
| 文件大小： | 0K |
| 描述： | IC MPU INTEGRATED 132-PQFP |
| 标准包装： | 36 |
| 系列： | M683xx |
| 处理器类型： | M683xx 32-位 |
| 速度： | 16MHz |
| 电压： | 5V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 132-BQFP 缓冲式 |
| 供应商设备封装： | 132-PQFP（24.13x24.13） |
| 包装： | 托盘 |
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8- 6
MC68306 USER'S MANUAL
MOTOROLA
8.7 AC ELECTRICAL SPECIFICATIONS—READ AND WRITE
CYCLES (Continued)
16.67 MHz
Num
Characteristic
Min
Max
Unit
20A6
AS Asserted to R/W Low (Write)
—
10
ns
212
Address Valid to R/W Low (Write)
0
—
ns
21A2
FC Valid to R/W Low (Write)
30
—
ns
222
R/ W Low to LDS, UDS Asserted (Write)
30
—
ns
23
CLKOUT Low to Data-Out Valid (Write)
—
30
ns
252
AS, LDS, UDS Negated to Data-Out Invalid (Write)
15
—
ns
262
Data-Out Valid to LDS, UDS Asserted (Write)
15
—
ns
275
Data-In Valid to CLKOUT Low (Setup Time on Read)
5
—
ns
282
AS, LDS, UDS Negated to DTACK Negated (Asynchronous
Hold)
0
110
ns
29
AS, LDS, UDS Negated to Data-In Invalid (Hold Time on Read)
0
—
ns
29A
AS, LDS, UDS Negated to Data-In High Impedance
—
90
ns
30
AS, LDS, UDS Negated to BERR Negated
0
—
ns
312,5
DTACK Asserted to Data-In Valid (Setup Time)
—
50
ns
32
HALT and RESET Input Transition Time
—
150
ns
475
Asynchronous Input Setup Time
5
—
ns
483
BERR Asserted to DTACK Asserted
10
—
ns
53
Data-Out Hold from CLKOUT High
0
—
ns
55
R/ W Asserted to Data Bus Impedance Change
0
—
ns
564
HALT/RESET Pulse Width
10
—
Clks
NOTES:
1.
For a loading capacitance of less than or equal to 50 pF, subtract 5 ns from the value given in the
maximum columns.
2.
Actual value depends on clock period.
3.
If #47 is satisfied for both DTACK and BERR, #48 may be ignored. In the absence of DTACK, BERR
is an asynchronous input using the asynchronous input setup time (#47).
4.
For power-up, the MC68306 must be held in the reset state for 100 ms to allow stabilization of on-chip
circuitry. After the system is powered up, #56 refers to the minimum pulse width required to reset the
controller.
5.
If the asynchronous input setup time (#47) requirement is satisfied for DTACK, the DTACK asserted to data
setup time (#31) requirement can be ignored. The data must only satisfy the data-in to clock low setup time
(#27) for the following clock cycle.
6.
When AS and R/W are equally loaded (
±20%), subtract 5 ns from the values given in these columns.
7.
The processor will negate BG and begin driving the bus again if external arbitration logic negates BR before
asserting BGACK.
8.
The minimum value must be met to guarantee proper operation. If the maximum value is exceeded, BG may be
reasserted.
9.
AS is always asserted, regardless of whether it is mapped to internal or external resources. If the designer
wishes to decode more chip selects than are provided, use one of CS0–7 as the enable for the external decode.
F
re
e
sc
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I
Freescale Semiconductor, Inc.
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c
..
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PDF描述 |
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参数描述 |
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| MC68306PV16 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Integrated EC000 Processor |
| MC68306PV20B | 制造商:Rochester Electronics LLC 功能描述:INTEGRATED EC000 MPU - Bulk |
| MC68307 | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
| MC68307AD | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
| MC68307UM | 制造商:MOTOROLA 制造商全称:Motorola, Inc 功能描述:Technical Summary Integrated Multiple-Bus Processor |
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