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参数资料
| 型号： | MC68HC11G5CFN |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | High-density Complementary Metal Oxide Semiconductor (HCMOS) Microcontroller |
| 中文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC84 |
| 封装： | PLASTIC, LCC-84 |
| 文件页数： | 81/195页 |
| 文件大小： | 839K |
| 代理商： | MC68HC11G5CFN |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页当前第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页
MC68HC11G5
PROGRAMMABLE TIMER
MOTOROLA
6-11
6.4.9
Output Compare 1 Action Data Register (OC1D)
OC1D7
OC1D6
OC1D5
OC1D4
OC1D3
0
0
0
OC1D
$
1
00D
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
0
RESET:
READ:
Any time (bits 2 – 0 always return 0).
WRITE:
Any time (writes to bits 2 – 0 have no meaning or effect).
RESET:
$00
OC1D is used to specify the data to be written to the affected bits of Port A as the result of
a successful OC1 compare. The bits of OC1D correspond bit-for-bit with the bits of Port A
(bits 3 – 7). When a successful OC1 compare occurs, for each bit that is set in OC1M, the
corresponding data bit in OC1D is written to the corresponding bit of Port A. If there is a
conflicting situation where an OC1 compare and another output compare function occur
during the same E-clock cycle, and both attempt to alter the same Port A bit, the OC1 action
will take priority.
One reason for providing this special capability on OC1 is to allow control of multiple I/O pins
automatically with a single output compare function. For example, if the OC2 and OC3 functions are
being used for internal timing functions, their associated Port A pins are free to be used for other
purposes. These two pins could be controlled simultaneously as high speed timed outputs using the
OC1 function by setting the two corresponding bits in the OC1M register to one.
The special I/O pin control on the OC1 function also allows more than one output compare function
to control a single I/O pin. For example, the OC1 function could be configured to affect only bit 3 of
Port A (by setting OC1M = $08). The OC5 function could set Port A bit 3 to a logic one and the OC1
function could reset it to a logic low on the very next count of the free-running counter.
6.4.10
Compare Force Register (CFORC)
FOC1
FOC2
FOC3
FOC4
FOC5
FOC6
FOC7
CFORC
$
1
00B
7
6
5
4
3
2
1
0
0
0
0
0
0
0
0
0
RESET:
READ:
Any time but will always return $00 (1 state is transient).
WRITE:
Any time (writes to bit 0 have no meaning or effect).
RESET:
$00 (no actions forced).
FOC1 to FOC7 — Force Output Compare “x” Action
Writing a one to bit “x” in this register causes the action which is programmed for output
compare “x” to occur at the next transition of the prescaled timer clock. The action taken
is the same as if a successful comparison had just taken place with the TOCx register,
with the exception that the interrupt flag is not set.
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