参数资料
型号: MCW68HC08LK60
厂商: MOTOROLA INC
元件分类: 微控制器/微处理器
英文描述: 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, UUC150
封装: WAFER-150
文件页数: 38/354页
文件大小: 1146K
代理商: MCW68HC08LK60
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NON-DISCLOSURE
AGREEMENT
REQUIRED
Clock Generator Module (CGMB)
Advance Information
MC68HC(9)08LK60 — Rev. 1.0
132
Clock Generator Module (CGMB)
MOTOROLA
7.7 Interrupts
When the AUTO bit is set in the PLL bandwidth control register (PBWC),
the PLL can generate a CPU interrupt request every time the LOCK bit
changes state. The PLLIE bit in the PLL control register (PCTL) enables
CPU interrupts from the PLL. PLLF, the interrupt flag in the PCTL,
becomes set whether interrupts are enabled or not. When the AUTO bit
is clear, CPU interrupts from the PLL are disabled and PLLF reads as
logic 0.
Software should read the LOCK bit after a PLL interrupt request to see
if the request was due to an entry into lock or an exit from lock. When the
PLL enters lock, the VCO clock, CGMVCLK, divided by two can be
selected as the CGMOUT source by setting BCS in the PCTL. When the
PLL exits lock, the VCO clock frequency is corrupt, and appropriate
precautions should be taken. If the application is not frequency-
sensitive, interrupts should be disabled to prevent PLL interrupt service
routines from impeding software performance or from exceeding stack
limitations.
NOTE:
Software can select the CGMVCLK divided by two as the CGMOUT
source even if the PLL is not locked (LOCK = 0). Therefore, software
should make sure the PLL is locked before setting the BCS bit.
7.8 Wait Mode
The WAIT instruction put the MCU in low power-consumption standby
mode.
The WAIT instruction does not affect the CGMB. Before entering wait
mode, software can disengage and turn off the PLL by clearing the BCS
and PLLON bits in the PLL control register (PCTL). Less power-sensitive
applications can disengage the PLL without turning it off. Applications
that require the PLL to wake the MCU from wait mode also can deselect
the PLL output without turning off the PLL.
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