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参数资料
| 型号： | MPC8377E-RDBA |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 112/127页 |
| 文件大小： | 0K |
| 描述： | BOARD REF DES MPC8377 REV 2.1 |
| 设计资源： | MPC8379E-RDB Ref Design Guide |
| 标准包装： | 1 |
| 系列： | PowerQUICC II™ PRO |
| 类型： | MPU |
| 适用于相关产品： | MPC8377E |
| 所含物品： | 板，CD |
| 相关产品： | MPC8378EVRANG-ND - MPU PWRQUICC II 800MHZ 689TEPBGA MPC8378EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8378EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA MPC8378EVRAGD-ND - MPU PWRQUICC II 400MHZ 689TEPBGA MPC8379EVRANG-ND - MPU PWRQUICC II 800MHZ 689TEPBGA MPC8379EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8379EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA MPC8379EVRAGD-ND - MPU PWRQUICC II 400MHZ 689TEPBGA MPC8377EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8377EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA 更多... |
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MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
Freescale Semiconductor
85
output driver features a 50-
Ω termination resistor. It also assumes that the LVDS transmitter establishes its
own common mode level without relying on the receiver or other external component.
Figure 57. AC-Coupled Differential Connection with LVDS Clock Driver (Reference Only)
Figure 58 shows the SerDes reference clock connection reference circuits for LVPECL type clock driver.
Since LVPECL driver’s DC levels (both common mode voltages and output swing) are incompatible with
device SerDes reference clock input’s DC requirement, AC-coupling has to be used. Figure 58 assumes
that the LVPECL clock driver’s output impedance is 50
Ω. R1 is used to DC-bias the LVPECL outputs
prior to AC-coupling. Its value could be ranged from 140
Ω to 240 Ω depending on clock driver vendor’s
requirement. R2 is used together with the SerDes reference clock receiver’s 50
Ω termination resistor to
attenuate the LVPECL output’s differential peak level such that it meets the device SerDes reference
clock’s differential input amplitude requirement (between 200 mV and 800 mV differential peak). For
example, if the LVPECL output’s differential peak is 900 mV and the desired SerDes reference clock input
amplitude is selected as 600 mV, the attenuation factor is 0.67, which requires R2 = 25
Ω. Consult clock
50
Ω
50
Ω
SD
n_REF_CLK
SD
n_REF_CLK
Clock Driver
100
Ω differential PWB trace
SerDes Refer.
CLK Receiver
Clock Driver
CLK_Out
LVDS CLK Driver Chip
10 nF
Chip
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PDF描述 |
|---|---|
| 0210490904 | CABLE JUMPER 1.25MM .102M 21POS |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MPC8377E-RDBA | 制造商:Freescale Semiconductor 功能描述:MPC837x Family Reference Desig |
| MPC8377EVRAFDA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
| MPC8377EVRAFFA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
| MPC8377EVRAFGA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
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