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参数资料
| 型号： | MPC8377E-RDBA |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 86/127页 |
| 文件大小： | 0K |
| 描述： | BOARD REF DES MPC8377 REV 2.1 |
| 设计资源： | MPC8379E-RDB Ref Design Guide |
| 标准包装： | 1 |
| 系列： | PowerQUICC II™ PRO |
| 类型： | MPU |
| 适用于相关产品： | MPC8377E |
| 所含物品： | 板，CD |
| 相关产品： | MPC8378EVRANG-ND - MPU PWRQUICC II 800MHZ 689TEPBGA MPC8378EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8378EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA MPC8378EVRAGD-ND - MPU PWRQUICC II 400MHZ 689TEPBGA MPC8379EVRANG-ND - MPU PWRQUICC II 800MHZ 689TEPBGA MPC8379EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8379EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA MPC8379EVRAGD-ND - MPU PWRQUICC II 400MHZ 689TEPBGA MPC8377EVRALG-ND - MPU PWRQUICC II 667MHZ 689TEPBGA MPC8377EVRAJF-ND - MPU PWRQUICC II 533MHZ 689TEPBGA 更多... |
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MPC8377E PowerQUICC II Pro Processor Hardware Specifications, Rev. 8
Freescale Semiconductor
61
15.2
AC Requirements for PCI Express SerDes Clocks
This table lists the PCI Express SerDes clock AC requirements.
15.3
Clocking Dependencies
The ports on the two ends of a link must transmit data at a rate that is within 600 parts per million (ppm)
of each other at all times. This is specified to allow bit rate clock sources with a ±300 ppm tolerance.
15.4
Physical Layer Specifications
Following is a summary of the specifications for the physical layer of PCI Express on this device. For
further details as well as the specifications of the transport and data link layer, use the PCI Express Base
Specification, Rev. 1.0a.
NOTE
The voltage levels of the transmitter and the receiver depend on the SerDes
control registers which should be programmed at the recommended values
for PCI Express protocol (that is, L1_nVDD = 1.0 V).
Table 51. SD_REF_CLK and SD_REF_CLK AC Requirements
Parameter
Symbol
Min
Typical
Max
Unit
Note
REFCLK cycle time
tREF
—10
—
ns
—
REFCLK cycle-to-cycle jitter. Difference in the period of any
two adjacent REFCLK cycles.
tREFCJ
—
100
ps
—
REFCLK phase jitter peak-to-peak. Deviation in edge
location with respect to mean edge location.
tREFPJ
–50
—
+50
ps
—
SD_REF_CLK/_B cycle to cycle clock jitter (period jitter)
tCKCJ
—
100
ps
—
SD_REF_CLK/_B phase jitter peak-to-peak. Deviation in
edge location with respect to mean edge location.
tCKPJ
–50
—
+50
ps
Notes:
1. All options provide serial interface bit rate of 1.5 and 3.0 Gbps.
2. In a frequency band from 150 kHz to 15 MHz, at BER of 10-12.
3. Total peak-to-peak Deterministic Jitter “JD” should be less than or equal to 50 ps.
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PDF描述 |
|---|---|
| 0210490904 | CABLE JUMPER 1.25MM .102M 21POS |
| EYM12DTBS-S189 | CONN EDGECARD 24POS R/A .156 SLD |
| 0210490240 | CABLE JUMPER 1.25MM .102M 18POS |
| EYM12DTAS-S189 | CONN EDGECARD 24POS R/A .156 SLD |
| 0210490239 | CABLE JUMPER 1.25MM .102M 18POS |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MPC8377E-RDBA | 制造商:Freescale Semiconductor 功能描述:MPC837x Family Reference Desig |
| MPC8377EVRAFDA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
| MPC8377EVRAFFA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
| MPC8377EVRAFGA | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:PowerQUICC? II Pro Processor Hardware Specifications |
| MPC8377EVRAGD | 功能描述:微处理器 - MPU PBGA W/ ENCR RoHS:否 制造商:Atmel 处理器系列:SAMA5D31 核心:ARM Cortex A5 数据总线宽度:32 bit 最大时钟频率:536 MHz 程序存储器大小:32 KB 数据 RAM 大小:128 KB 接口类型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作电源电压:1.8 V to 3.3 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:FBGA-324 |
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