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参数资料
| 型号： | MPC961PAC |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 9/13页 |
| 文件大小： | 0K |
| 描述： | IC BUFFER ZD 1:18 PLL 32-LQFP |
| 标准包装： | 250 |
| 类型： | 零延迟缓冲器 |
| PLL： | 是 |
| 输入： | LVPECL |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:17 |
| 差分 - 输入:输出： | 是/无 |
| 频率 - 最大： | 200MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-LQFP |
| 供应商设备封装： | 32-TQFP（7x7） |
| 包装： | 托盘 |
MPC961P REVISION 5 JANUARY 8, 2013
5
2013 Integrated Device Technology, Inc.
MPC961P Data Sheet
LOW VOLTAGE ZERO DELAY BUFFER
Table 7. AC Characteristics (VCC = 2.5 V 5%, TA = –40° to 85°C)(1)
1. AC characteristics apply for parallel output termination of 50
to VTT.
Symbol
Characteristics
Min
Typ
Max
Unit
Condition
fREF
Input Frequency
F_RANGE = 0
F_RANGE = 1
100
50
200
100
MHz
fMAX
Maximum Output Frequency
F_RANGE = 0
F_RANGE = 1
100
50
200
100
MHz
fREFDC
Reference Input Duty Cycle
25
75
%
t()
Propagation Delay(2)
CCLK to FB_IN
(static phase offset)
2. tPD applies for VCMR = VCC –1.3 V and VPP = 800 mV.
–50
175
ps
PLL locked
tsk(O)
Output-to-Output Skew(3)
3. Refer to APPLICATIONS INFORMATION for part-to-part skew calculation.
90
150
ps
DCO
Output Duty Cycle
F_RANGE = 0
F_RANGE = 1
40
45
50
60
55
%
tr, tf
Output Rise/Fall Time
0.1
1.0
ns
0.6 to 1.8 V
tPLZ,HZ
Output Disable Time
10
ns
tPZL,LZ
Output Enable Time
10
ns
tJIT(CC)
Cycle-to-Cycle Jitter
RMS (1
)(4)
4. Refer to APPLICATIONS INFORMATION for calculation for other confidence factors than 1
15
ps
tJIT(PER)
Period Jitter
RMS (1
)
7.0
10
ps
tJIT()
I/O Phase Jitter
RMS (1
)F_RANGE = 0
F_RANGE = 1
0.0015
T
0.0010
T
T = Clock Signal
Period
tlock
Maximum PLL Lock Time
10
ms
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