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参数资料
| 型号： | PIC12F1840T-I/MF |
| 厂商： | Microchip Technology |
| 文件页数： | 95/122页 |
| 文件大小： | 0K |
| 描述： | MCU 7KB FLASH 256B RAM XLP 8DFN |
| 标准包装： | 3,300 |
| 系列： | PIC® XLP™ 12F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 32MHz |
| 连通性： | I²C，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 5 |
| 程序存储器容量： | 7KB（4K x 14） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.3 V ~ 5.5 V |
| 数据转换器： | A/D 4x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 8-VDFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
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PIC12(L)F1840
DS41441B-page 74
Preliminary
2011 Microchip Technology Inc.
7.10
Determining the Cause of a Reset
Upon any Reset, multiple bits in the STATUS and
PCON register are updated to indicate the cause of the
tions of these registers.
TABLE 7-3:
RESET STATUS BITS AND THEIR SIGNIFICANCE
TABLE 7-4:
RESET CONDITION FOR SPECIAL REGISTERS(2)
STKOVF STKUNF
RMCLR
RI
POR
BOR
TO
PD
Condition
00
1
0
x
1
Power-on Reset
00
1
0
x
0
x
Illegal, TO is set on POR
00
1
0
x
0
Illegal, PD is set on POR
00
1
u
0
1
Brown-out Reset
uu
u
0
u
WDT Reset
uu
u
0
WDT Wake-up from Sleep
uu
u
1
0
Interrupt Wake-up from Sleep
uu
0
u
MCLR Reset during normal operation
uu
0
u
1
0
MCLR Reset during Sleep
u
0
u
RESET
Instruction Executed
1u
u
Stack Overflow Reset (STVREN = 1)
u1
u
Stack Underflow Reset (STVREN = 1)
Condition
Program
Counter
STATUS
Register
PCON
Register
Power-on Reset
0000h
---1 1000
00-- 110x
MCLR Reset during normal operation
0000h
---u uuuu
uu-- 0uuu
MCLR Reset during Sleep
0000h
---1 0uuu
uu-- 0uuu
WDT Reset
0000h
---0 uuuu
uu-- uuuu
WDT Wake-up from Sleep
PC + 1
---0 0uuu
uu-- uuuu
Brown-out Reset
0000h
---1 1uuu
00-- 11u0
Interrupt Wake-up from Sleep
PC + 1(1)
---1 0uuu
uu-- uuuu
RESET
Instruction Executed
0000h
---u uuuu
uu-- u0uu
Stack Overflow Reset (STVREN = 1)
0000h
---u uuuu
1u-- uuuu
Stack Underflow Reset (STVREN = 1)
0000h
---u uuuu
u1-- uuuu
Legend: u
= unchanged, x = unknown, - = unimplemented bit, reads as ‘0’.
Note 1:
When the wake-up is due to an interrupt and Global Enable bit (GIE) is set, the return address is pushed on
the stack and PC is loaded with the interrupt vector (0004h) after execution of PC + 1.
2:
If a Status bit is not implemented, that bit will be read as ‘0’.
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