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参数资料
| 型号： | PIC16LC642-04/SP |
| 厂商： | Microchip Technology |
| 文件页数： | 95/125页 |
| 文件大小： | 0K |
| 描述： | IC MCU OTP 4KX14 COMP 28DIP |
| 产品培训模块： | Asynchronous Stimulus |
| 标准包装： | 15 |
| 系列： | PIC® 16C |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 外围设备： | 欠压检测/复位，LED，POR，WDT |
| 输入/输出数： | 22 |
| 程序存储器容量： | 7KB（4K x 14） |
| 程序存储器类型： | OTP |
| RAM 容量： | 176 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 6 V |
| 振荡器型： | 外部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 28-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页当前第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页
Micrel, Inc.
KSZ8862-16/32MQL
April 2007
71
M9999-040407-3.0
Bit
Default
R/W
Description
1
0
RW
Legal Maximum Packet Size Check Enable
0 = accepts packet sizes up to 1536 bytes (inclusive).
1 = 1522 bytes for tagged packets, 1518 bytes for untagged packets. Any packets larger than the
specified value are dropped.
0
1
RW
Priority Buffer Reserve
1 = each port is pre-allocated 48 buffers, used exclusively for high priority (q3, q2, and q1) packets.
Effective only when the multiple queue feature is turned on.
0 = each port is pre-allocated 48 buffers used for all priority packets (q3, q2,q1, and q0).
Bank 32 Switch Global Control Register 3 (0x06): SGCR3
This register contains the global control for the switch function.
Bit
Default
R/W
Description
15-8
0x63
RW
Broadcast Storm Protection Rate Bit [7:0]
These bits, along with SGCR3[2:0], determine how many 64-byte blocks of packet data are allowed
on an input port in a preset period. The period is 67ms for 100BT or 670ms for 10BT. The default is
1%.
7
0
RW
Reserved
6
0
RW
Switch Host Half-Duplex Mode
1 = enable host port interface half-duplex mode.
0 = enable host port interface full-duplex mode.
5
0
RW
Switch Flow Control Enable
1 = enable full-duplex flow control on Switch Host port.
0 = disable full-duplex flow control on Switch Host port.
4
0
RW
Reserved
3
0
RW
Null VID Replacement
1 = replaces NULL VID with port VID(12 bits).
0 = no replacement for NULL VID.
2-0
0x0
RW
Broadcast Storm Protection Rate Bit [10:8]
These bits, along with SGCR3[15:8] determine how many 64-byte blocks of packet data are allowed
on an input port in a preset period. The period is 67ms for 100BT or 670ms for 10BT. The default is
1%.
Rate: 148,800 frames/sec * 67 ms/interval * 1% = 99 frames/interval (approx.) = 0x63.
Bank 32 Switch Global Control Register 4 (0x08): SGCR4
This register contains the global control for the switch function.
Bit
Default
R/W
Description
15-0
0x2400
RW
Reserved
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PDF描述 |
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参数描述 |
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