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参数资料
| 型号： | S29CD032J1JFAI122 |
| 厂商： | SPANSION LLC |
| 元件分类： | PROM |
| 英文描述： | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
| 封装： | 13 X 11 MM, 1 MM PITCH, FORTIFIED, BGA-80 |
| 文件页数： | 54/78页 |
| 文件大小： | 1825K |
| 代理商： | S29CD032J1JFAI122 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页当前第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
56
S29CD-J & S29CL-J Flash Family
S29CD-J_CL-J_00_B1 September27,2006
Prel imi n ary
18.2 Asynchronous Operations
Notes:
1. Not 100% tested.
2. See Figure 16.1 and Table 17.1 for test specifications.
3. TOE during Read Array.
Figure 18.2 Conventional Read Operations Timings
Table 18.2 Asynchronous Read Operations
Parameter
Description
Test Setup
Speed Options
Unit
JEDEC Std.
75MHz
0R
66MHz
0P
56MHz
0M
40MHz
0J
tAVAV
tRC Read Cycle Time (Note 1)
Min
48545454
ns
tAVQV tACC Address to Output Delay
CE# = VIL
OE# = VIL
Max
48545454
ns
tELQV
tCE Chip Enable to Output Delay
OE# = VIL Max
52545454
ns
tGLQV
tOE Output Enable to Output Delay
Max
20
ns
tEHQZ
tDF
Chip Enable to Output High Z
Max
10
ns
Min
2
ns
Max
10
ns
Read
Min
0
ns
Toggle and Data# Polling
Min
10
ns
tAXQX tOH
Output Hold Time From Addresses, CE# or OE#, Whichever Occurs
First (Note 1)
Min
2
ns
tCE
Outputs
WE#
Addresses
CE#
OE#
High Z
Output Valid
High Z
Addresses Stable
tRC
tACC
tOEH
tOE
0 V
RY/BY#
RESET#
tDF
tOH
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