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参数资料
| 型号： | S29CD032J1JFAI122 |
| 厂商： | SPANSION LLC |
| 元件分类： | PROM |
| 英文描述： | 1M X 32 FLASH 2.7V PROM, 54 ns, PBGA80 |
| 封装： | 13 X 11 MM, 1 MM PITCH, FORTIFIED, BGA-80 |
| 文件页数： | 62/78页 |
| 文件大小： | 1825K |
| 代理商： | S29CD032J1JFAI122 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页
September 27, 2006 S29CD-J_CL-J_00_B1
S29CD-J & S29CL-J Flash Family
63
Pr el im i n a r y
Note: SA = sector address (for Sector Erase), VA = Valid Address for reading status data (see “Write Operation Status” ).
Figure 18.9 Chip/Sector Erase Operation Timings
Figure 18.10 Back-to-back Cycle Timings
OE#
CE#
Addresses
VCC
WE#
Data
2AAh
SA
tAH
tWP
tWC
tAS
tWPH
555h for chip erase
10 for Chip Erase
30h
tDS
tVCS
tCS
tDH
55h
tCH
In
Progress
Complete
tWHWH2
VA
Erase Command Sequence (last two cycles)
Read Status Data
RY/BY#
tRB
tBUSY
OE#
CE#
WE#
Addresses
tOH
Data
Valid
In
Valid
In
Valid PA
Valid RA
tWC
tWPH
tAH
tWP
tDS
tDH
tRC
tCE
Valid
Out
tOE
tACC
tOEH
tGHWL
tDF
Valid
In
CE# Controlled Write Cycles
WE# Controlled Write Cycle
Valid PA
tCP
tCPH
tWC
Read Cycle
tSR/W
tWPH
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