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参数资料
| 型号： | SI5325C-C-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 11/62页 |
| 文件大小： | 0K |
| 描述： | IC UP-PROG CLK MULTIPLIER 36-QFN |
| 标准包装： | 490 |
| 系列： | DSPLL® |
| 类型： | 时钟乘法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 346MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 供应商设备封装： | 36-QFN（6x6） |
| 包装： | 托盘 |
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Si5325
Rev. 0.5
19
4. Register Descriptions
Reset value = 0001 0100
Register 0.
Bit
D7
D6
D5
D4D3D2
D1
D0
Name
CKOUT_ALWAYS_ON
BYPASS_REG
Type
RR
R/W
R
R/W
R
Bit
Name
Function
7:6
Reserved
5
CKOUT_ALWAYS_ON
CKOUT Always On.
This will bypass the SQ_ICAL function. Output will be available even if
SQ_ICAL is on and ICAL is not complete or successful. See Table 9 on
0: Squelch output until part is calibrated (ICAL).
1: Provide an output. Note: The frequency may be significantly off until the
part is calibrated.
4:2
Reserved
1
BYPASS_REG
Bypass Register.
This bit enables or disables the PLL bypass mode. Use only when the device
is in VCO freeze or before the first ICAL. Bypass mode is not supported for
CMOS output clocks.
0: Normal operation
1: Bypass mode. Selected input clock is connected to CKOUT buffers,
bypassing PLL. Bypass mode is not supported for CMOS outputs.
0
Reserved
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
| SI5325C-C-GMR | 功能描述:时钟发生器及支持产品 mP-Program Precision Clk Multiplier 2/2 RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
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| SI5326A-B-GMR | 制造商:Silicon Laboratories Inc 功能描述: |
| Si5326A-C-GM | 功能描述:时钟合成器/抖动清除器 ANY-RATE CLK MULT JITTER ATTEN 2 OUTS RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
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