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参数资料
| 型号： | SI5325C-C-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 58/62页 |
| 文件大小： | 0K |
| 描述： | IC UP-PROG CLK MULTIPLIER 36-QFN |
| 标准包装： | 490 |
| 系列： | DSPLL® |
| 类型： | 时钟乘法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 346MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 供应商设备封装： | 36-QFN（6x6） |
| 包装： | 托盘 |
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Si5325
Rev. 0.5
61
DOCUMENT CHANGE LIST
Revision 0.23 to Revision 0.24
Clarified that the two outputs have a common, higher
frequency source on page 1.
Changed LVTTL to LVCMOS in Table 2, “Absolute
Maximum Ratings,” on page 5.
Added Figure 1, “Typical Phase Noise Plot,” on page
4.
Updated “5. Pin Descriptions: Si5325”.
Removed references to latency control, INC, and DEC.
Changed font for register names to underlined italics.
Updated "6. Ordering Guide" on page 56.
Revision 0.24 to Revision 0.25
Updated Section "5. Pin Descriptions: Si5325" on
Revision 0.25 to Revision 0.26
Removed Figure 1. “Typical Phase Noise Plot.”
Changed pins 11 and 15 from NC to VDD in “5. Pin
Revision 0.26 to Revision 0.3
Changed 1.8 V operating range to ±5%.
Updated Table 1 on page 4.
Updated Table 2 on page 5.
Added page 14.
Clarified "5. Pin Descriptions: Si5325" on page 52
including pull-up/pull-down.
Revision 0.3 to Revision 0.4
Added register map
Lowered minimum CKOUT frequency
Updated spec tables
ESD tolerance, Table 2 on page 5
Minimum input and output clock frequencies, Table 1 on
page 4
Absolute maximum VDD voltage, Table 2 on page 5
Added to spec table
CKIN voltage limits, Table 2 on page 5
Typical jitter and phase noise values, Table 1 on page 4
No bypass mode with CMOS outputs
Revision 0.4 to Revision 0.5
Expanded electrical specification tables 1 through 7.
Removed support for CMOS outputs in Bypass
mode.
Corrected minor errors in register map section.
Updated " Features" on page 1“.
Added “not recommended for new designs” language.
Updated Table 5 on page 52.
Updated "6. Ordering Guide" on page 56.
Removed note from "5. Pin Descriptions: Si5325" on
相关PDF资料 |
PDF描述 |
|---|---|
| M83723/84G08036 | CONN RCPT 3POS JAM NUT W/SCKT |
| AD5530BRUZ | IC DAC 12BIT SRL IN/VOUT 16TSSOP |
| MS3454L20-15S | CONN RCPT 7POS JAM NUT W/SCKT |
| AD5322BRMZ | IC DAC 12BIT DUAL 10MSOP |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| SI5325C-C-GMR | 功能描述:时钟发生器及支持产品 mP-Program Precision Clk Multiplier 2/2 RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| SI5326 | 制造商:SILABS 制造商全称:SILABS 功能描述:ANY-RATE PRECISION CLOCK MULTIPLIER/JITTER ATTENUATOR |
| Si5326A-B-GM | 功能描述:时钟合成器/抖动清除器 ANY-RATE CLK MULT JITTER ATTEN 2 OUTS RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
| SI5326A-B-GMR | 制造商:Silicon Laboratories Inc 功能描述: |
| Si5326A-C-GM | 功能描述:时钟合成器/抖动清除器 ANY-RATE CLK MULT JITTER ATTEN 2 OUTS RoHS:否 制造商:Skyworks Solutions, Inc. 输出端数量: 输出电平: 最大输出频率: 输入电平: 最大输入频率:6.1 GHz 电源电压-最大:3.3 V 电源电压-最小:2.7 V 封装 / 箱体:TSSOP-28 封装:Reel |
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