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参数资料
| 型号： | SI5325C-C-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 3/62页 |
| 文件大小： | 0K |
| 描述： | IC UP-PROG CLK MULTIPLIER 36-QFN |
| 标准包装： | 490 |
| 系列： | DSPLL® |
| 类型： | 时钟乘法器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML，CMOS，LVDS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:2 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 346MHz |
| 除法器/乘法器： | 是/是 |
| 电源电压： | 1.71 V ~ 3.63 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-VFQFN 裸露焊盘 |
| 供应商设备封装： | 36-QFN（6x6） |
| 包装： | 托盘 |
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Si5325
Rev. 0.5
11
PLL Performance
(fin = fout = 622.08 MHz; BW = 120 Hz; LVPECL)
Lock Time
tLOCKMP
Start of ICAL to
of LOL
—
35
1200
ms
Closed Loop Jitter
Peaking
JPK
—0.05
0.1
dB
Jitter Tolerance
JTOL
Jitter Frequency
Loop
Bandwidth
5000/BW
—
ns pk-pk
Phase Noise
fout = 622.08 MHz
CKOPN
1 kHz Offset
—
–90
—
dBc/Hz
10 kHz Offset
—
–113
—
dBc/Hz
100 kHz Offset
—
–118
—
dBc/Hz
1 MHz Offset
—
–132
—
dBc/Hz
Subharmonic Noise
SPSUBH
Phase Noise @ 100 kHz
Offset
—–88
—
dBc
Spurious Noise
SPSPUR
Max spur @ n x F3
(n
1, n x F3 < 100 MHz)
—–93
—
dBc
Table 4. Microprocessor Control
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
I2C Bus Lines (SDA, SCL)
Input Voltage Low
VILI2C
—
0.25 x VDD
V
Input Voltage High
VIHI2C
0.7 x VDD
—VDD
V
Hysteresis of Schmitt
trigger inputs
VHYSI2C
VDD = 1.8V
0.1 x VDD
——
V
VDD = 2.5 or 3.3 V
0.05 x VDD
——
V
Output Voltage Low
VOLI2C
VDD =1.8 V
IO = 3 mA
—
0.2 x VDD
V
VDD =2.5 or 3.3V
IO = 3 mA
——
0.4
V
Table 3. AC Characteristics (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
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参数描述 |
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