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参数资料
| 型号： | SPAK56F807VF80 |
| 厂商： | MOTOROLA INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
| 封装： | MOLD ARRAY PROCESS, BGA-160 |
| 文件页数： | 31/48页 |
| 文件大小： | 853K |
| 代理商： | SPAK56F807VF80 |
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JTAG Timing
MOTOROLA
DSP56F807 Preliminary Technical Data
37
3.14 JTAG Timing
Table 38. JTAG Timing1, 3
Operating Conditions: VSS = VSSA = 0 V, VDD = VDDA = 3.0–3.6 V, TA = –40° to +85°C, CL ≤ 50 pF, fOP = 80MHz
1.
Timing is both wait state and frequency dependent. For the values listed, T = clock cycle. For 80 MHz operation,
T = 12.5 ns.
Characteristic
Symbol
Min
Max
Unit
TCK frequency of operation2
2.
TCK frequency of operation must be less than 1/8 the processor rate.
3.
Parameters listed are guaranteed by design.
fOP
DC
10
MHz
TCK cycle time
tCY
100
—ns
TCK clock pulse width
tPW
50
—
ns
TMS, TDI data setup time
tDS
0.4
—
ns
TMS, TDI data hold time
tDH
1.2
—
ns
TCK low to TDO data valid
tDV
—
26.6
ns
TCK low to TDO tri-state
tTS
—
23.5
ns
TRST assertion time
tTRST
50
—
ns
DE assertion time
tDE
4T
—
ns
Figure 30. Test Clock Input Timing Diagram
TCK
(Input)
VM
VIL
VM = VIL + (VIH – VIL)/2
tPW
tCY
tPW
VM
VIH
相关PDF资料 |
PDF描述 |
|---|---|
| SPAK56F807VF80 | 16-BIT, 80 MHz, OTHER DSP, PBGA160 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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