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参数资料
型号： ST10F269Z2Q6
厂商： STMICROELECTRONICS
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
封装： 28 X 28 MM, PLASTIC, QFP-144
文件页数： 62/184页
文件大小： 3276K
代理商： ST10F269Z2Q6
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页
ST10F269
154/184
t9
CC
ALE falling edge to RD, WR (no
RW-delay)
-10 + tA
–-10 + tA
–ns
t10
CC
Address float after RD, WR
(with RW-delay)
1
–6
–
6
ns
t11
CC
Address float after RD, WR
(no RW-delay)
1
–
21.625
–
TCL + 6
ns
t12
CC
RD, WR low time
(with RW-delay)
21.25 + tC
–
2TCL - 10 + tC
–ns
t13
CC
RD, WR low time
(no RW-delay)
36.875 + tC
–
3TCL - 10 + tC
–ns
t14
SR
RD to valid data in
(with RW-delay)
–
11.25 + tC
–
2TCL - 20+ tC
ns
t15
SR
RD to valid data in
(no RW-delay)
–
26.875 + tC
–
3TCL - 20+ tC
ns
t16
SR
ALE low to valid data in
–
26.875 + tA + tC
–
3TCL - 20
+ tA + tC
ns
t17
SR
Address/Unlatched CS to valid
data in
–
32.5 + 2tA + tC
–
4TCL - 30
+ 2tA + tC
ns
t18
SR
Data hold after RD
rising edge
0–
0
–
ns
t19
SR
Data float after RD
1
–
17.25 + tF
–
2TCL - 14 + tF
ns
t22
CC
Data valid to WR
11.25 + tC
–
2TCL - 20 + tC
–ns
t23
CC
Data hold after WR
17.25 + tF
–
2TCL - 14 + tF
–ns
t25
CC
ALE rising edge after RD, WR
17.25 + tF
–
2TCL - 14 + tF
–ns
t27
CC
Address/Unlatched CS hold
after RD, WR
17.25 + tF
–
2TCL - 14 + tF
–ns
t38
CC
ALE falling edge to Latched CS
-4 - tA
10 - tA
-4 - tA
10 - tA
ns
t39
SR
Latched CS low to Valid Data In
–
26.875 + tC + 2tA
–
3TCL - 20
+ tC + 2tA
ns
t40
CC
Latched CS hold after RD, WR
32.875 + tF
–
3TCL - 14 + tF
–ns
t42
CC
ALE fall. edge to RdCS, WrCS
(with RW delay)
11.625 + tA
–TCL - 4 + tA
–ns
t43
CC
ALE fall. edge to RdCS, WrCS
(no RW delay)
-4 + tA
–-4 + tA
–ns
Symbol
Parameter
Maximum CPU Clock =
32MHz
Variable CPU Clock
1/2 TCL = 1 to 32MHz
Un
it
Minimum
Maximum
Minimum
Maximum
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