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参数资料
| 型号： | ST7PL35F2MCXXXRE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO20 |
| 封装： | 0.300 INCH, ROHS COMPLIANT, PLASTIC, SOP-20 |
| 文件页数： | 122/168页 |
| 文件大小： | 2955K |
| 代理商： | ST7PL35F2MCXXXRE |
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Obsolete
Product(s)
- Obsolete
Product(s)
ST7L34, ST7L35, ST7L38, ST7L39
57/168
DUAL 12-BIT AUTORELOAD TIMER 3 (cont’d)
Dead Time Generation
A dead time can be inserted between PWM0 and
PWM1 using the DTGR register. This is required
for half-bridge driving where PWM signals must
not be overlapped. The non-overlapping PWM0/
PWM1 signals are generated through a program-
mable dead time by setting the DTE bit.
Dead time value = DT[6:0] x Tcounter1
DTGR[7:0] is buffered inside so as to avoid de-
forming the current PWM cycle. The DTGR effect
will take place only after an overflow.
Notes:
1. Dead time is generated only when DTE = 1 and
DT[6:0]
≠ 0. If DTE is set and DT[6:0] = 0, PWM
output signals will be at their reset state.
2. Half-bridge driving is possible only if polarities of
PWM0 and PWM1 are not inverted, that is, if OP0
and OP1 are not set. If polarity is inverted, overlap-
ping PWM0/PWM1 signals will be generated.
Figure 39. Dead Time Generation
In the above example, when the DTE bit is set:
– PWM goes low at DCR0 match and goes high at
ATR1+Tdt
– PWM1 goes high at DCR0+Tdt and goes low at
ATR match.
With this programmable delay (Tdt), the PWM0
and PWM1 signals which are generated are not
overlapped.
DCR0+1
ATR1
DCR0
Tdt
Tdt = DT[6:0] x Tcounter1
PWM 0
PWM 1
CNTR1
CK_CNTR1
Tcounter1
OVF
PWM 0
PWM 1
if
DT
E
=
0
if
DT
E
=
1
counter = DCR0
counter = DCR1
1
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PDF描述 |
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