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参数资料
| 型号： | ST7PL35F2MCXXXRE |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO20 |
| 封装： | 0.300 INCH, ROHS COMPLIANT, PLASTIC, SOP-20 |
| 文件页数： | 128/168页 |
| 文件大小： | 2955K |
| 代理商： | ST7PL35F2MCXXXRE |
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Obsolete
Product(s)
- Obsolete
Product(s)
ST7L34, ST7L35, ST7L38, ST7L39
62/168
DUAL 12-BIT AUTORELOAD TIMER 3 (cont’d)
– At the second input capture on the falling edge of
the pulse, we assume that the values in the reg-
isters are as follows:
LTICR = LT2
ATICRH = ATH2
ATICRL = ATL2
Hence ATICR2 [11:0] = ATH2 & ATL2
Now pulse width P between first capture and sec-
ond capture will be:
P = decimal (F9 – LT1 + LT2 + 1) * 0.004ms + dec-
imal (ATICR2 - ATICR1 – 1) * 1ms
Figure 45. Long Range Input Capture Timing Diagram
11.2.4 Low Power Modes
11.2.5 Interrupts
Notes:
1. The CMP and AT3 IC events are connected to the
same interrupt vector. The OVF event is mapped on a
separate vector (see Interrupts chapter). They generate
an interrupt if the enable bit is set in the ATCSR register
and the interrupt mask in the CC register is reset (RIM in-
struction).
2. Only if CK0 = 1 and CK1 = 0 (fCOUNTER =fLTIMER)
F9h
00h
LT1
F9h
00h
LT2
ATH1 & ATL1
00h
0h
LT1
ATH1
LT2
ATH2
fOSC/32
TB Counter1
CNTR1
LTIC
LTICR
ATICRH
00h
ATL1
ATL2
ATICRL
ATICR = ATICRH[3:0] & ATICRL[7:0]
_ _ _
ATH2 & ATL2
_ _ _
Mode
Description
SLOW
The input frequency is divided by 32
WAIT
No effect on AT timer
ACTIVE
HALT
AT timer halted except if CK0 = 1,
CK1 = 0 and OVFIE = 1
HALT
AT timer halted
Interrupt
Event1)
Event
Flag
Enable
Control
Bit
Exit
from
WAIT
Exit
from
HALT
Exit
from
ACTIVE
HALT
Overflow
Event
OVF1
OVFIE1
Yes
No
Yes2)
AT3 IC
Event
ICF
ICIE
Yes
No
CMP Event CMPFx CMPIE
Yes
No
1
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