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参数资料
| 型号： | ST7PLITEUS5M6TR |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDSO8 |
| 封装： | 0.150 INCH, LEAD FREE, PLASTIC, SOP-8 |
| 文件页数： | 96/108页 |
| 文件大小： | 1957K |
| 代理商： | ST7PLITEUS5M6TR |
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ST7LITEUSx
88/108
12.10 10-BIT ADC CHARACTERISTICS
Subject to general operating condition for VDD, fOSC, and TA unless otherwise specified.
Notes:
1. Unless otherwise specified, typical data are based on TA=25°C and VDD-VSS=5V. They are given only as design guide-
lines and are not tested.
2. The maximum ADC clock frequency allowed within VDD = 2.4V to 2.7V operating range is 1MHz.
3. When VDDA and VSSA pins are not available on the pinout, the ADC refers to VDD and VSS.
4. Any added external serial resistor will downgrade the ADC accuracy (especially for resistance greater than 10k
). Data
based on characterization results, not tested in production.
5. The stabilization time of the A/D converter is masked by the first tLOAD. The first conversion after the enable is then
always valid.
Figure 64. Typical Application with ADC
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
fADC
ADC clock frequency 2)
4MHz
VAIN
Conversion voltage range 3)
VSSA
VDDA
V
RAIN
External input resistor
VDD = 5V, fADC=4MHz
8k 4)
VDD = 3.3V, fADC=4MHz
7k 4)
2.7V
≤ V
DD ≤5.5V, fADC=2MHz
10k 4)
2.4V
≤ V
DD ≤2.7V, fADC=1MHz
TBD 4)
CADC
Internal sample and hold capacitor
3
pF
tSTAB
Stabilization time after ADC enable
fCPU=8MHz, fADC=4MHz
0 5)
s
tADC
Conversion time (Sample+Hold)
3.5
- Sample capacitor loading time
- Hold conversion time
4
10
1/fADC
AINx
ST7LITEUSx
VDD
IL
±1
A
VT
0.6V
VT
0.6V
CADC
VAIN
RAIN
10-Bit A/D
Conversion
1
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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