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参数资料
| 型号： | TC59SM808BFTL-70 |
| 元件分类： | DRAM |
| 英文描述： | 32M X 8 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| 封装： | 0.400 INCH, 0.80 MM PITCH, PLASTIC, TSOP2-54 |
| 文件页数： | 3/49页 |
| 文件大小： | 2437K |
| 代理商： | TC59SM808BFTL-70 |
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TC59SM816/08/04BFT/BFTL-70,-75,-80
2001-06-11
11/49
Control Timing of Input Data (TC59SM808/M804)
Control Timing of Output Data (TC59SM808/M804)
DQ0~DQ7
(DQ0~DQ3)*
DQM
CLK
tCMH
tCMS
tCMH
tCMS
tAC
tOH
tAC
tLZ
tAC
tOH
tHZ
tOH
Output
data valid
Output
data valid
(Output Enable)
(Clock Mask)
Output
data valid
tAC
tOH
DQ0~DQ7
(DQ0~DQ3)*
CKE
CLK
tCKH
tCKS
tCKH
tCKS
tOH
tAC
tOH
tAC
tOH
Output
data valid
Output
data valid
tAC
tOH
Output data valid
Open
*: TC59SM804
DQ0~DQ7
(DQ0~DQ3)*
DQM
CLK
tCMH
tCMS
tCMH
tCMS
tDH
tDS
Input
data valid
Input
data valid
Input
data valid
Input
data valid
CKE
CLK
tCKH
tCKS
tCKH
tCKS
tDH
tDS
Input
data valid
tDH
tDS
tDH
tDS
tDH
tDS
Input
data valid
Input
data valid
Input
data valid
(Word Mask)
(Clock Mask)
DQ0~DQ7
(DQ0~DQ3)*
tDH
tDS
tDH
tDS
tDH
tDS
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