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参数资料
| 型号： | TPS51020EVM-001 |
| 厂商： | Texas Instruments |
| 文件页数： | 14/28页 |
| 文件大小： | 0K |
| 描述： | EVAL MODULE FOR TPS51020-001 |
| 标准包装： | 1 |
| 主要目的： | DC/DC，步降 |
| 输出及类型： | 2，非隔离 |
| 输出电压： | 3.3V，5V |
| 电流 - 输出： | 6A，6A |
| 输入电压： | 8 ~ 20 V |
| 稳压器拓扑结构： | 降压 |
| 频率 - 开关： | 300kHz |
| 板类型： | 完全填充 |
| 已供物品： | 板 |
| 已用 IC / 零件： | TPS51020 |
| 产品目录页面： | 1028 (CN2011-ZH PDF) |
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| 其它名称： | 296-18958 |
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TPS51020
SLUS564C ? JULY 2003 ? REVISED OCTOBER 2008
APPLICATION INFORMATION
10-V N-CHANNEL FET BIAS or (VOUT1)/2 VTT VOLTAGE REFERENCE (REF_X)
TPS51020’s REF_X provides two functions depending on the operational mode. One is a linear regulator that
supply 10-V for FET switch biasing in the dual mode, the other is V TT reference voltage in the DDR mode.
If DDR is high ( > 2.2 V) then the REF_X output is a convenient 10-V, 2-mA (maximum) output, useful for biasing
N-channel FET switches typically used to manage S0, S3 and S5 sleep states where the main supply is switched
to many outputs. When V IN is < 12 V, REF_X approximately tracks V IN ?2 V.
If DDR is low, then the REF_X output becomes the VDDQ/2 (VO1_VDDQ/2) reference. This output is capable
of 5-mA source current and is left on even if channel two (V TT switcher) is turned off. REF_X is turned off if ENBL1
and ENBL2 are both low (see Table 2).
POWERGOOD
The TPS51020 has advanced powergood logic that allows single powergood circuit to monitor both SMPS
output voltages (see Figure 3 ).
VOUT1
VOUT2
2048 c
PGOOD Delay Counter
2048 c
PGOOD
ENBL1
Resets Delay Counter
ENBL2
t0
t1
t2
Figure 3. PowerGood Timing Diagram
The PGOOD terminal is an open drain output. The PGOOD pin remains low until both power supplies have
started and have been in regulation ( ± 7.5%) for 2048 clock pulses.
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www.ti.com
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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