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参数资料
| 型号： | uPSD3212 |
| 厂商： | 意法半导体 |
| 英文描述： | Flash Programmable System Device with 8032 Microcontroller Core(嵌入高速“8032微控制器核”的Flash型可编程系统器件) |
| 中文描述： | 闪存可编程系统器件与8032微控制器内核（嵌入高速“8032微控制器核”的闪存型可编程系统器件） |
| 文件页数： | 35/155页 |
| 文件大小： | 1055K |
| 代理商： | UPSD3212 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页当前第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页
35/155
μPSD321X
Table 17. PSD Module Register Address Offset
CSIOP
Addr
Offset
Register Name
Bit Register Name
Reset
Value
Comments
7
6
5
4
3
2
1
0
00
Data In (Port A)
Reads Port pins as input
02
Control (Port A)
Configure pin between I/O or Address Out Mode. Bit = 0 selects I/
O
00
04
Data Out (Port A)
Latched data for output to Port pins, I/O Output Mode
00
06
Direction (Port A)
Configures Port pin as input or output. Bit = 0 selects input
00
08
Drive (Port A)
Configures Port pin between CMOS, Open Drain or Slew rate. Bit
= 0 selects CMOS
00
0A
Input Macrocell
(Port A)
Reads latched value on Input Macrocells
0C
Enable Out
(Port A)
Reads the status of the output enable control to the Port pin driver.
Bit = 0 indicates pin is in input mode.
01
Data In (Port B)
03
Control (Port B)
00
05
Data Out (Port B)
00
07
Direction (Port B)
00
09
Drive (Port B)
00
0B
Input Macrocell
(Port B)
0D
Enable Out
(Port B)
10
Data In (Port C)
12
Data Out (Port C)
00
14
Direction (Port C)
00
16
Drive (Port C)
00
18
Input Macrocell
(Port C)
1A
Enable Out
(Port C)
11
Data In (Port D)
*
*
*
*
*
*
Only Bit 1 and
2 are used
13
Data Out (Port D)
*
*
*
*
*
*
00
Only Bit 1 and
2 are used
15
Direction (Port D)
*
*
*
*
*
*
00
Only Bit 1 and
2 are used
17
Drive (Port D)
*
*
*
*
*
*
00
Only Bit 1 and
2 are used
1B
Enable Out
(Port D)
*
*
*
*
*
*
Only Bit 1 and
2 are used
20
Output
Macrocells AB
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