参数资料
| 型号： | XA3S400A-4FGG400I |
| 厂商： | Xilinx Inc |
| 文件页数： | 13/57页 |
| 文件大小： | 0K |
| 描述： | IC FPGA SPARTAN-3A 400K 400-FBGA |
| 产品培训模块： | Extended Spartan 3A FPGA Family |
| 标准包装： | 60 |
| 系列： | Spartan®-3A XA |
| LAB/CLB数： | 896 |
| 逻辑元件/单元数： | 8064 |
| RAM 位总计： | 368640 |
| 输入/输出数： | 311 |
| 门数： | 400000 |
| 电源电压： | 1.14 V ~ 1.26 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -40°C ~ 100°C |
| 封装/外壳： | 400-BGA |
| 供应商设备封装： | 400-FBGA（21x21） |
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XA Spartan-3A Automotive FPGA Family Data Sheet
DS681 (v2.0) April 22, 2011
Product Specification
20
TIOPICKD
Time from the setup of data at the
Input pin to the active transition at
the ICLK input of the Input
Flip-Flop (IFF). The Input Delay is
programmed.
LVCMOS25(2)
1
XA3S200A
2.20
ns
22.93
ns
33.78
ns
44.37
ns
54.20
ns
65.23
ns
76.11
ns
86.71
ns
1
XA3S400A
2.02
ns
22.67
ns
33.43
ns
43.96
ns
53.95
ns
64.81
ns
75.66
ns
86.19
ns
1
XA3S700A
1.95
ns
22.83
ns
33.72
ns
44.31
ns
54.14
ns
65.19
ns
76.10
ns
86.73
ns
1
XA3S1400A
2.17
ns
22.92
ns
33.76
ns
44.32
ns
54.19
ns
65.09
ns
75.98
ns
86.57
ns
Hold Times
TIOICKP
Time from the active transition at
the ICLK input of the Input
Flip-Flop (IFF) to the point where
data must be held at the Input pin.
No Input Delay is programmed.
LVCMOS25(3)
0
XA3S200A
–0.65
ns
XA3S400A
–0.42
ns
XA3S700A
–0.67
ns
XA3S1400A
–0.71
ns
Table 20: Setup and Hold Times for the IOB Input Path (Cont’d)
Symbol
Description
Conditions
IFD_
DELAY_
VALUE
Device
Speed Grade: -4
Units
Min
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