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参数资料
| 型号： | 71M6531D-IM/F |
| 厂商： | TERIDIAN SEMICONDUCTOR CORP |
| 元件分类： | 电源管理 |
| 英文描述： | 1-CHANNEL POWER SUPPLY MANAGEMENT CKT, QCC68 |
| 封装： | LEAD FREE, QFN-68 |
| 文件页数： | 101/120页 |
| 文件大小： | 2477K |
| 代理商： | 71M6531D-IM/F |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页当前第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页
FDS 6531/6532 005
Data Sheet 71M6531D/F-71M6532D/F
v1.3
2005-2010 TERIDIAN Semiconductor Corporation
81
Name
Location
Reset
Wake
Dir
Description
IEN_WD_NROVF 20B0[0]
0
R/W
Active high watchdog near overflow interrupt enable.
IE_XFER
IE_RTC
SFR E8[0]
SFR E8[1]
0
R/W
Interrupt flags. These flags monitor the XFER_BUSY interrupt and the RTC_1SEC
interrupt. The flags are set by hardware and clear automatically.
IE_WAKE
SFR E8[5]
0
–
R/W
Indicates that the MPU was awakened by the autowake timer. This bit is typically read
by the MPU on bootup. The firmware must write a zero to this bit to clear it.
INTBITS
SFR F8[6:0]
–
R/W
Interrupt inputs. The MPU may read these bits to see the status of external interrupts
INT0, INT1 up to INT6. These bits do not have any memory and are primarily intended
for debug use.
LCD_BITMAP
[31:24]
2023
0
L
R/W
Configuration for DIO11/SEG31 through DIO4/SEG24. Unused bits should be set to zero.
1 = LCD pin, 0 = DIO pin. Check Table 54 for bit availability.
LCD_BITMAP
[39:32]
2024
0
L
R/W
Bitmap of DIO19/SEG39 through DIO12/SEG32. Unused bits should be set to zero.
1 = LCD pin, 0 = DIO pin. Check Table 54 for bit availability.
LCD_BITMAP
[55:48]
2026
0
L
R/W
Bitmap of DIO28/SEG48 through DIO35/SEG55. Unused bits should be set to zero.
1 = LCD pin, 0 = DIO pin. Check Table 54 for bit availability.
LCD_BITMAP
[63:56]
2027
0
L
R/W
Bitmap of DIO36/SEG56 through DIO43/SEG63. Unused bits should be set to zero.
1 = LCD pin, 0 = DIO pin. Check Table 54 for bit availability.
LCD_BITMAP
[71:64]
2028
0
L
R/W
Bitmap of DIO44/SEG64 through DIO51/SEG71. Unused bits should be set to zero.
1 = LCD pin, 0 = DIO pin. Check Table 54 for bit availability.
LCD_BLKMAP19
[3:0]
LCD_BLKMAP18
[3:0]
205A[7:4]
205A[3:0]
0
L
R/W
Identifies which segments connected to SEG18 and SEG19 should blink. 1 means
blink. The most significant bit corresponds to COM3, the least significant bit to COM0.
LCD_CLK[1:0]
2021[1:0]
0
L
R/W
Sets the LCD clock frequency for COM/SEG pins (not
00 = fw/2
9
frame rate) according to the
following (fw = 32768 Hz):
01 = fw/2
8
10 = fw/2
7
11 = fw/2
6
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