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参数资料
| 型号： | A54SX08A-2CQ208 |
| 厂商： | Electronic Theatre Controls, Inc. |
| 元件分类： | FPGA |
| 英文描述： | SX-A Family FPGAs |
| 中文描述： | 的SX - A系列FPGA的 |
| 文件页数： | 26/108页 |
| 文件大小： | 720K |
| 代理商： | A54SX08A-2CQ208 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页当前第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页
SX-A Family FPGAs
2-6
v5.1
Table 2-10
AC Specifications (3.3 V PCI Operation)
Symbol
Parameter
Condition
Min.
Max.
Units
I
OH(AC)
Switching Current High
0 < V
OUT
≤
0.3V
CCI
1
0.3V
CCI
≤
V
OUT
< 0.9V
CCI
1
0.7V
CCI
< V
OUT
< V
CCI
1, 2
–12V
CCI
–
mA
(–17.1(V
CCI
– V
OUT
))
–
mA
–
EQ 2-3 on
page 2-7
–
(Test Point)
V
OUT
= 0.7V
CC 2
V
CCI
> V
OUT
≥
0.6V
CCI
1
0.6V
CCI
> V
OUT
> 0.1V
CCI
1
0.18V
CCI
> V
OUT
> 0
1, 2
–
–32V
CCI
mA
I
OL(AC)
Switching Current Low
16V
CCI
–
mA
(26.7V
OUT
)
–
mA
–
EQ 2-4 on
page 2-7
–
(Test Point)
V
OUT
= 0.18V
CC 2
–3 < V
IN
≤
–1
V
CCI
+ 4 > V
IN
≥
V
CCI
+ 1
0.2V
CCI
- 0.6V
CCI
load
3
0.6V
CCI
- 0.2V
CCI
load
3
–
38V
CCI
mA
I
CL
Low Clamp Current
–25 + (V
IN
+ 1)/0.015
–
mA
I
CH
High Clamp Current
25 + (V
IN
– V
CCI
– 1)/0.015
–
mA
slew
R
Output Rise Slew Rate
1
4
V/ns
slew
F
Output Fall Slew Rate
1
4
V/ns
Notes:
1. Refer to the V/I curves in
Figure 2-2 on page 2-7
. Switching current characteristics for REQ# and GNT# are permitted to be one half
of that specified here; i.e., half size output drivers may be used on these signals. This specification does not apply to CLK and RST#,
which are system outputs. “Switching Current High” specifications are not relevant to SERR#, INTA#, INTB#, INTC#, and INTD#,
which are open drain outputs.
2. Maximum current requirements must be met as drivers pull beyond the last step voltage. Equations defining these maximums (C
and D) are provided with the respective diagrams in
Figure 2-2 on page 2-7
. The equation defined maximum should be met by
design. In order to facilitate component testing, a maximum current test point is defined for each side of the output driver.
3. This parameter is to be interpreted as the cumulative edge rate across the specified range, rather than the instantaneous rate at any
point within the transition range. The specified load (diagram below) is optional; i.e., the designer may elect to meet this parameter
with an unloaded output per the latest revision of the PCI Local Bus Specification. However, adherence to both maximum and
minimum parameters is required (the maximum is no longer simply a guideline). Rise slew rate does not apply to open drain
outputs.
Output
Buffer
1/2 in. max.
10 pF
Pin
1 k/25
1 k/25
Pin
Buffer
Output
10 pF
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PDF描述 |
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