参数资料
| 型号： | ACS8946T |
| 厂商： | Semtech |
| 文件页数： | 4/40页 |
| 文件大小： | 0K |
| 描述： | IC JITTER ATT MULT PLL 48-QFN |
| 标准包装： | 1 |
| 类型： | 时钟/频率发生器，多路复用器 |
| PLL： | 是 |
| 主要目的： | 以太网，SONET/SDH |
| 输入： | LVPECL |
| 输出： | CML，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:4 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 625MHz |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 供应商设备封装： | 48-QFN（7x7） |
| 包装： | 托盘 |
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ADVANCED COMMUNICATIONS
FINAL
DATASHEET
Revision 3/November 2006 Semtech Corp.
Page 12
www.semtech.com
ACS8946 JAM PLL
such that if any phase error signal is present, the LOCKB
output drives out a +10
A current, otherwise it is off.
Consequently this output (LOCKB) is a pulse width
modulated (PWM) pulse stream whose mark/space ratio
indicates the current input phase error. Filtering this
signal with a simple external RC parallel filter as shown in
Figure 9 will give a signal whose output level indicates PLL
phase and frequency lock.
Figure 9 Lock Filter Components
The filtering components are external so that the time to
indicate lock or not locked can be optimized for the
application. The output indicates both phase and
frequency lock. During off-frequency conditions the
LOCKB output will be predominately high in its PWM
generation with the filtered version giving a constant high
state.
PLL Bandwidth Setting
The bandwidth is set by two identical sets of passive RC
components that connect to the differential charge pump
outputs and internal VCO control inputs. Pins VCN and
VCP are the combined differential charge pump outputs
and VCO control voltage inputs. Figure 10 shows the
arrangement.
Figure 10 Loop Filter Components
All capacitors should be low leakage and low ESR
(Equivalent Series Resistance). Tantalum, or ceramic
damping factor of 1.2 (phase margin 80.2°). Higher
damping factors may be used if lower transfer peaking is
required. Contact Semtech Sales Support for further
details.
RC Components Required to Achieve Bandwidth at
Note...* not available at 155.52 MHz input
Note...All bandwidths are subject to ± 20% variation due to
component tolerancing.
LOCKB
JA
M
P
L
R1
470K
LOCK_B
C1
220nF
GND
F8944_011Lockfilter_02
VCP
VCN
JA
M
P
L
C1
R1
R2
C3
C4
GND
C2
F8943_010Loopfilter_02
Table 6 77.76 MHz or 19.44 MHz Input Frequency
Bandwidth
R1 & R2/
C2 & C4/
F
C1 & C3
nF
Closed Loop
1500
56
33
200
2000
75
15
100
4000
150
4.7
33
8000
270
0.68
7.5
Table 7 155.52 MHz or 38.88 MHz Input Frequency
Bandwidth
R1 & R2/
C2 & C4/
F
C1 & C3
nF
Closed Loop
1500*
110
15
91
2000
150
6.8
47
4000
300
2.2
15
8000
560
0.47
3.9
Table 8 125 MHz Input Frequency
Bandwidth
R1 & R2/
C2 & C4/
F
C1 & C3
nF
Closed Loop
1500
68
22
150
2000
91
15
91
4000
180
3.3
20
8000
360
0.68
6.2
相关PDF资料 |
PDF描述 |
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