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参数资料
| 型号： | AD9520-1BCPZ-REEL7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 74/80页 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN 2.5GHZ VCO 64LFCSP |
| 设计资源： | Synchronizing Multiple AD9910 1 GSPS Direct Digital Synthesizers (CN0121) Phase Coherent FSK Modulator (CN0186) |
| 标准包装： | 750 |
| 类型： | 时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | CMOS，LVDS，LVPECL |
| 输出： | CMOS，LVPECL |
| 电路数： | 1 |
| 比率 - 输入:输出： | 2:12，2:24 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 2.65GHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 64-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 64-LFCSP-VQ（9x9） |
| 包装： | 带卷 (TR) |
| 配用： | AD9520-1/PCBZ-ND - BOARD EVAL FOR AD9520-1 |
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AD9520-1
Data Sheet
Rev. A | Page 76 of 80
Table 61. EEPROM Control
Reg.
Addr.
(Hex)
Bits
Name
Description
0xB00
[7:1]
Unused
Unused.
0
STATUS_EEPROM
(read only)
This read-only register indicates the status of the data transfer between the EEPROM and the buffer
register bank during the writing and reading of the EEPROM. This signal is also available at the STATUS
pin when Register 0x01D[7] is set.
0: data transfer is complete.
1: data transfer is not complete.
0xB01
[7:1]
Unused
Unused.
0
EEPROM data error
(read only)
This read-only register indicates an error during the data transfer between the EEPROM and the buffer.
0: no error. Data is correct.
1: incorrect data detected.
0xB02
[7:2]
Unused
Unused.
1
SOFT_EEPROM
When the EEPROM pin is tied low, setting SOFT_EEPROM resets the AD9520 using the settings saved
in the EEPROM.
1: soft reset with EEPROM settings (self-clearing).
0
Enable EEPROM
write
Enables the user to write to the EEPROM.
0: EEPROM write protection is enabled. User cannot write to the EEPROM (default).
1: EEPROM write protection is disabled. User can write to the EEPROM. Once an EEPROM save/load
transfer is complete, the user must wait a minimum of 10 s before starting the next EEPROM
save/load transfer.
0xB03
[7:1]
Unused
Unused.
0
REG2EEPROM
Transfers data from the buffer register to the EEPROM (self-clearing).
1: setting this bit initiates the data transfer from the buffer register to the EEPROM (writing process);
it is reset by the IC master after the data transfer is complete. Once an EEPROM save/load transfer
is complete, the user must wait a minimum of 10 s before starting the next EEPROM save/load transfer.
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