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参数资料
| 型号： | ADAU1461WBCPZ-R7 |
| 厂商： | Analog Devices Inc |
| 文件页数： | 58/88页 |
| 文件大小： | 0K |
| 描述： | IC SIGMADSP 24BIT 96KHZ PLL 32 |
| 标准包装： | 1,500 |
| 系列： | SigmaDSP® |
| 类型： | 音频处理器 |
| 应用： | 车载音频 |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 32-VFQFN 裸露焊盘，CSP |
| 供应商设备封装： | 32-LFCSP-VQ |
| 包装： | 带卷 (TR) |
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ADAU1461
Rev. 0 | Page 61 of 88
R16: Serial Port Control 1, 16,406 (0x4016)
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
BPF[2:0]
ADTDM
DATDM
MSBP
LRDEL[1:0]
Table 48. Serial Port Control 1 Register
Bits
Bit Name
Description
[7:5]
BPF[2:0]
Number of bit clock cycles per LRCLK audio frame.
Setting
Bit Clock Cycles
000
64 (default)
001
Reserved
010
48
011
128
100
256
101
Reserved
110
Reserved
111
Reserved
4
ADTDM
ADC serial audio data channel position in TDM mode.
0 = left first (default).
1 = right first.
3
DATDM
DAC serial audio data channel position in TDM mode.
0 = left first (default).
1 = right first.
2
MSBP
MSB position in the LRCLK frame.
0 = MSB first (default).
1 = LSB first.
[1:0]
LRDEL[1:0]
Data delay from LRCLK edge (in BCLK units).
Setting
Delay (Bit Clock Cycles)
00
1 (default)
01
0
10
8
11
16
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