参数资料
型号: ADSP-21160NCB-100
厂商: ANALOG DEVICES INC
元件分类: 数字信号处理
英文描述: 64-BIT, 50 MHz, OTHER DSP, PBGA400
封装: 27 X 27 MM, METRIC, PLASTIC, MS-034BAL-2, BGA-400
文件页数: 37/60页
文件大小: 1296K
代理商: ADSP-21160NCB-100
Rev. B
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February 2010
ADSP-21160M/ADSP-21160N
Table 28. Link Ports—Transmit
Parameter
Min
Max
Unit
Timing Requirements
tSLACH
LACK Setup Before LCLK High
14
ns
tHLACH
LACK Hold After LCLK High
–2
ns
Switching Characteristics
tDLDCH
Data Delay After LCLK High
4
ns
tHLDCH
Data Hold After LCLK High
–2
ns
tLCLKTWL
LCLK Width Low
1
0.5tLCLK – 0.5
0.5tLCLK+0.5
ns
tLCLKTWH
LCLK Width High
2
0.5tLCLK –0.5
0.5tLCLK+0.5
ns
tDLACLK
LCLK Low Delay After LACK High
3
0.5tLCLK+4
3/2tLCLK+11
ns
1 For ADSP-21160M, specification is 0.5tLCLK–1.5 ns (minimum) and 0.5tLCLK+1.5 ns (maximum).
2 For ADSP-21160M, specification is 0.5tLCLK–1.5 ns (minimum) and 0.5tLCLK+1.5 ns (maximum).
3 For ADSP-21160M, specification is 0.5tLCLK+5 ns (minimum) and 3tLCLK+11 ns (maximum).
Figure 25. Link Ports—Transmit
LCLK
LDAT(7:0)
LACK (IN)
THE
tSLACH REQUIREMENT APPLIES TO THE RISING EDGE OF LCLK ONLY FOR THE FIRST NIBBLE/BYTE TRANSMITTED.
TRANSMIT
LAST NIBBLE/BYTE
TRANSMITTED
FIRST NIBBLE/BYTE
TRANSMITTED
LCLK INACTIVE
(HIGH)
OUT
tDLDCH
tHLDCH
tLCLKTWH
tLCLKTWL
tSLACH
tHLACH
tDLACLK
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