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参数资料
| 型号： | ADSP-21368KBPZ-2A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 26/64页 |
| 文件大小： | 0K |
| 描述： | IC DSP 32BIT 333MHZ 256-BGA |
| 产品培训模块： | SHARC Processor Overview |
| 标准包装： | 1 |
| 系列： | SHARC® |
| 类型： | 浮点 |
| 接口： | DAI，DPI |
| 时钟速率： | 333MHz |
| 非易失内存： | ROM（768 kB） |
| 芯片上RAM： | 256kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.20V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA 裸露焊盘 |
| 供应商设备封装： | 256-BGA（27x27） |
| 包装： | 托盘 |
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Rev. F
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October 2013
Memory Write
Use these specifications for asynchronous interfacing to memo-
ries. These specifications apply when the processors are the bus
masters, accessing external memory space in asynchronous
access mode. Note that timing for ACK, DATA, RD, WR, and
strobe timing parameters only applies to asynchronous access
mode.
Table 25. Memory Write
Parameter
Min
Max
Unit
Timing Requirements
t
DAAK
ACK Delay from Address, Selects1, 2
t
SDCLK – 9.7 + W
ns
t
DSAK
ACK Delay from WR Low 1, 3
W – 4.9
ns
Switching Characteristics
t
DAWH
Address, Selects to WR Deasserted
t
SDCLK –3.1 + W
ns
t
DAWL
Address, Selects to WR Low
t
SDCLK –2.7
ns
t
WW
WR Pulse Width
W – 1.3
ns
t
DDWH
Data Setup Before WR High
t
SDCLK –3.0 + W
ns
t
DWHA
Address Hold After WR Deasserted
H + 0.15
ns
t
DWHD
Data Hold After WR Deasserted
H + 0.02
ns
t
WWR
WR High to WR, RD Low
t
SDCLK –1.5 + H
ns
t
DDWR
Data Disable Before RD Low
2t
SDCLK – 4.11
ns
t
WDE
Data Enabled to WR Low
t
SDCLK – 3.5
ns
W = (number of wait states specified in AMICTLx register) × t
SDCLK.
H = (number of hold cycles specified in AMICTLx register) × t
SDCLK.
1 ACK delay/setup: System must meet tDAAK, or tDSAK, for deassertion of ACK (low). For asynchronous assertion of ACK (high), user must meet tDAAK or tDSAK.
2 The falling edge of MSx is referenced.
3 Note that timing for ACK, DATA, RD, WR, and strobe timing parameters only applies to asynchronous access mode.
Figure 20. Memory Write
ACK
DATA
tDAWH
tDWHA
tWWR
tDATRWH
tDWHD
tWW
tDDWR
tDDWH
tDAWL
tWDE
tDSAK
tDAAK
RD
WR
ADDR
MSx
相关PDF资料 |
PDF描述 |
|---|---|
| MC79M15CT | IC REG LDO -15V .5A TO220AB |
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| VI-21T-CW-F4 | CONVERTER MOD DC/DC 6.5V 100W |
| MC79M12CT | IC REG LDO -12V .5A TO220AB |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| ADSP-21368SKBP-ENG | 制造商:AD 制造商全称:Analog Devices 功能描述:Preliminary Technical Data |
| ADSP-21368SKBPZENG | 制造商:AD 制造商全称:Analog Devices 功能描述:Preliminary Technical Data |
| ADSP-21369 | 制造商:AD 制造商全称:Analog Devices 功能描述:The ADSP-21367/ADSP-21368/ADSP-21369 are available with a 400 MHz core instruction rate with unique audiocentric peripherals such as the digital audio interface, S/PDIF transceiver, serial ports, 8-channel asynchronous sample rate converter, precision clock generators, and more. |
| ADSP-21369BBP-2A | 功能描述:IC DSP 32BIT 333MHZ 256-BGA RoHS:否 类别:集成电路 (IC) >> 嵌入式 - DSP（数字式信号处理器） 系列:SHARC® 标准包装:2 系列:StarCore 类型:SC140 内核 接口:DSI，以太网，RS-232 时钟速率:400MHz 非易失内存:外部 芯片上RAM:1.436MB 电压 - 输入/输出:3.30V 电压 - 核心:1.20V 工作温度:-40°C ~ 105°C 安装类型:表面贴装 封装/外壳:431-BFBGA，FCBGA 供应商设备封装:431-FCPBGA（20x20） 包装:托盘 |
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